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SN65LVDS301
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SLLS681 - 2006年2月
主动模式
当TXEN高， PCLK的时钟输入信号大于3MHz的快， SN65LVDS301进入活动
模式。电流消耗在Active模式下取决于操作频率和数据转换的数量
在数据有效负载。
收购模式（ PLL途径锁定）
PLL使能，并尝试锁定到输入时钟。所有输出保持在高阻抗模式。当
PLL的监控检测PLL稳定运行，该设备由采集切换到发送模式。为了正确
设备的操作中，像素时钟频率必须落在指定的有效频率fPCLK范围内根据推荐
操作条件。如果象素时钟频率低于3MHz的大于f但小
PCLK
（分钟），则
SN65LVDS301 PLL被使能。在这种情况下，有可能对于PLL临时锁定到像素
钟，使PLL的显示器释放设备到发射模式。如果这种情况发生时，PLL可以或不可以
正确锁定到像素时钟输入，从而可能导致数据错误，低频振荡，和PLL
死锁（亏损VCO振荡） 。
传输模式
之后，PLL达到锁定，设备进入正常发送模式。 CLK引脚输出PCLK的副本。
根据所选择的操作模式中， D1，D2和D3的输出进位序列化的数据。在1个通道
模式下，输出D2和D3保持高阻抗。在2声道模式中，输出D3的保持高阻抗。
产品预览
奇偶校验位产生
该SN65LVDS301发射机计算发送数据字的奇偶性，并将奇偶校验位相应。
奇偶校验位包括由像素数据加VS ，HS和DE 24位的27位的数据有效载荷。两
保留位不包括在所述奇偶校验位生成。奇校验位信令使用。发射机设置
奇偶校验位，如果在27个数据位的总和导致偶数的那些。奇偶校验位被清除，否则。这
允许接收器验证校验和检测单个位错误。
状态检测和操作模式流程图
节省功率并以下面的方式有源模式之间的切换SN65LVDS301 ：
POWERUP
TXEN = 0
TXEN低
＆ GT ; 10
m
s
POWERUP
TXEN = 1
CLK无效
关闭
模式
TXEN高> 10
m
s
待机
模式
PCLK
活跃
PCLK
停止或丢失
POWERUP
TXEN = 1
CLK活跃
TXEN低
＆ GT ; 10
m
s
TXEN低
＆ GT ; 10
m
s
PCLK
停止或丢失
发送
模式
PLL达到锁定
获得
模式
图6.状态检测和操作模式流程图
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