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K4B1G04(08/16)46C
4.0输入/输出功能描述
(表3)输入/输出功能描述
符号
CK , CK
TYPE
输入
功能
1GB DDR3 SDRAM
时钟:
CK和CK是差分时钟输入。所有地址和控制输入信号采样上的交叉
CK和CK的下降沿的上升沿。输出(读取)数据为参考CK和CK的口岸
时钟使能:
CKE高激活,并且CKE低停用,内部时钟信号和设备的输入缓冲器和
输出驱动器。以CKE低提供预充电掉电和自刷新操作(所有银行闲置) ,或
主动掉电(行活动在任何一家银行) 。 CKE是异步的自刷新退出。之后VREFCA已成为
上的电源和初始化序列期间稳定的,它必须在所有的操作(包括自我维持
刷新) 。 CKE必须保持在整个读取和写入访问高。输入缓冲器,但不包括CK , CK , ODT
和CKE是在断电期间禁用。输入缓冲器,除CKE ,被禁止在自-refresh 。
片选:
当CS为高电平注册的所有命令被屏蔽。 CS为外部排名的选择
系统具有多个队伍。 CS被认为是命令代码的一部分。
片上终端:
ODT (注册HIGH )使终端电阻内部的DDR3 SDRAM 。当
启用, ODT仅施加到每个DQ , DQS , DQS和DM / TDQS ,NU / TDQS (当TDQS经由模式中启用
寄存器A11 = 1, MR1 )信号为x8配置。如果模式寄存器( MR1 )是亲的ODT引脚将被忽略
编程禁用ODT 。
输入命令:
RAS , CAS和WE (连同CS )被定义输入的命令。
输入数据掩码:
DM为输入掩码信号为写入数据。当DM采样高coinci-输入数据被屏蔽
在写存取与输入数据的凹痕。 DM进行采样DQS的两边。对于x8的装置中,所述功能
DM或TDQS / TDQS是由MR1模式寄存器A11设置启用。
银行地址输入:
BA0 - BA2确定哪个银行的积极,读,写或预充电命令是
应用。银行地址也确定了模式寄存器和扩展模式寄存器是在一个被访问
MRS循环。
地址输入:
所提供的行地址为有效的命令和列地址进行读/写命令
选择一个位置在各个银行的存储器阵列的。 (A10 / AP和A12 / BC具有附加功能,
见下文)
地址输入时也模式寄存器设置命令提供的操作码。
Autoprecharge :
A10是在读/写命令采样,以确定是否Autoprecharge工作必须
形成为读/写操作后,所访问的银行。 (高: Autoprecharge ; LOW :无Autoprecharge )
A10在一个预充电命令周期内采样,以确定是否预充电适用于一个银行(A10低)或
所有银行( A10 HIGH ) 。如果只有一家银行被预充电,该银行选择通过银行地址。
突发印章: A12
在读取采样和写入命令,以确定是否爆裂斩(上即时)将per-
形成的。 (高:不爆裂斩, LOW :爆裂斩) 。详情请参见命令真值表
低电平有效异步复位:
复位有效时, RESET为低,不活动时RESET为高。
复位必须在正常操作期间为高电平。 RESET是CMOS轨到轨信号的直流高和低,在80 %和
的VDD的20 %,即1.20V直流高和0.30V直流低。
数据输入/输出:
双向数据总线。
数据选通:
输出读取数据,输入与写入数据。边沿对齐的读数据,集中在写入数据。
终端数据选通:
TDQS / TDQS仅适用于X8 DRAM的。当通过模式寄存器A11中启用= 1
MR1 , DRAM将使上TDQS / TDQS施加到DQS / DQS相同的终端电阻的功能。当
通过模式寄存器禁用A11 = 0 MR1 , DM / TDQS将提供数据屏蔽功能, TDQS不使用。
无连接:
无内部电气连接是否存在。
DQ电源:
1.5V +/- 0.075V
DQ地面
电源:
1.5V +/- 0.075V
参考电压DQ
参考电压CA
参考引脚ZQ校准
CKE
输入
CS
输入
ODT
输入
RAS , CAS , WE
DM
( DMU ) , ( DML )
输入
输入
BA0 - BA2
输入
A0 - A12
输入
A10 / AP
输入
A12 / BC
输入
RESET
DQ
DQS ( DQS )
TDQS , ( TDQS )
输入
输入/输出
输入/输出
产量
NC
V
DDQ
V
SSQ
V
DD
V
SS
V
REFDQ
V
REFCA
ZQ
供应
供应
供应
供应
供应
供应
供应
注:仅输入引脚( BA0 - BA2 , A0 -A12 , RAS , CAS,WE , CS , CKE , ODT和RESET )不提供端接。
第11页共63
1.0版2007年6月

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