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集成
电路
系统公司
初步信息
M2050/51/52
SAW PLL
为
10G
B
E 64
B
/66
B
FEC
P
IN
A
SSIGNMENT
( 9 ×9mm的SMT)的
FIN_SEL1
GND
P_SEL2
DIF_REF0
nDIF_REF0
REF_SEL
DIF_REF1
nDIF_REF1
VCC
FIN_SEL0
FEC_SEL0
FEC_SEL1
大声笑
NBW
VCC
DNC
DNC
DNC
27
26
25
24
23
22
21
20
19
G
ENERAL
D
ESCRIPTION
在M2050 / 51/ 52是VCSO (压控SAW
振荡器)的时钟锁相环
专为FEC时钟比率
翻译的10Gb光纤系统
如万兆以太网64b / 66b 。它支持
两个映射和去映射
64B / 66B编码和FEC
(前向纠错)时钟
乘法比率。的比率是从销选
预编程的查找表。
F
EATURES
◆
集成SAW延迟线;为15 700 MHz的输出
*
◆
低相位抖动< 0.5 ps的典型均方根
( 12kHz至20MHz或50Hz至80MHz的)
◆
引脚可选的PLL分频比支持64B / 66B和
FEC编码/解码的比例:
M2050 :地图万兆局域网,二百三十八分之二百五十五FEC ,或二百三十七分之二百五十五FEC
M2051 :德地图的10GbE LAN或238分之255 FEC到10GbE
M2052 :德地图二百三十七分之二百五十五FEC & 238分之255 FEC到10GbE LAN
28
29
30
31
32
33
34
35
36
M2050
M2051
M2052
( TOP VIEW )
18
17
16
15
14
13
12
11
10
P_SEL0
P_SEL1
nFOUT0
FOUT0
GND
nFOUT1
FOUT1
VCC
GND
图1 :引脚分配
◆
可扩展的分频器提供进一步的调整环
带宽和抖动容限
◆
LVPECL时钟输出( CML和LVDS可供选择)
◆
参考时钟输入支持差分LVDS ,
LVPECL ,以及单端LVCMOS , LVTTL
◆
失锁( LOL )输出引脚
◆
窄带宽控制输入( NBW引脚)
◆
无中断切换( HS)选择有或无期
打造出( PBO )可用;业绩符合
SONET ( GR - 253 ) / SDH ( G.813 )在MTIE和TDEV
参考时钟重选
◆
单3.3V电源
◆
小9 ×9mm的SMT(表面贴装)封装
例如I / O时钟频率组合
使用M2050映射器PLL
输入基地
率(兆赫)
1
625.0000
625.0000
644.5313
映射比率
Mfec / RFEC
(引脚可选)
GND
GND
GND
OP_IN
nOP_OUT
雷士
VC
OP_OUT
nOP_IN
1
2
3
4
5
6
7
8
9
VCSO *和基地
产出率
(兆赫)
2
644.5313
669.6429
690.5692
33 / 32
15 / 14
15 / 14
表1 :实施例的I / O时钟频率的组合
注1 :输入参考时钟可以是基准利率的“ MFIN ”划分。
注2 :输出速度可以基本利率由“P”划分。
*指定在订购时VCSO中心频率。
S
IMPLIFIED
B
LOCK
D
IAGRAM
环
滤波器
M2050, 51, 52
NBW
大声笑
MUX
DIF_REF0
nDIF_REF0
DIF_REF1
nDIF_REF1
REF_SEL
FEC_SEL1 : 0
FIN_SEL1 : 0
P_SEL2 : 0
2
相
探测器
0
1
RFEC
DIV
VCSO
Mfec股利
Mfec和RFEC
分频器
LUT
MFIN分频器
(1, 4, 5, 25)
P分频器
MFIN分频器
LUT
P分频器
LUT
(1, 4,5, 25或三态)
三态
FOUT0
nFOUT0
FOUT1
nFOUT1
2
3
图2 :简化框图
M2050 / 51/52数据表版本1.0
M2050 / 51/52 SAW PLL的10GbE 64B / 66B FEC
●
修订后的23Jun2005
通讯模块
●
集成电路系统公司
W W瓦特I C S T 。 C 0米
●
电话:( 508 ) 852-5400