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AD9863
表17.寄存器位说明
寄存器位
寄存器0x00 ：一般
第7位： SDIO双向（双向）
描述
默认设置为低，这表明SPI串行端口使用专用的输入和输出线
（4线接口） ，SDIO引脚和SDO引脚上。设置此位高配置串行
端口使用SDIO引脚作为双向数据引脚。
默认设置为低，这表明MSB第一个SPI端口的访问模式。设置此位高
配置SPI端口访问LSB优先模式。
写高该寄存器复位所有的寄存器到默认值并强制PLL来
重新锁定到输入时钟。软复位位是一次性注册后立即清除
该寄存器写入完成。
这些位表示的时钟接口的各种模式。设置000为默认值。设置111
用于克隆模式。指的是灵活的I / O模式部分的摘要克隆的定义
模式。
环境
模式
000
标准的FD ， HD12 ， HD24时钟（模式1 ， 4,7）
001
可选的FD定时（模式2）
010
未使用
011
可选HD24定时（模式5 ）
100
未使用
101
可选HD12定时（模式8 ）
110
未使用
111
复制模式（模式10 ）
使IFACE2端口为输出时钟。也反转在全双工模式下IFACE2输出时钟。
反转的IFACE3输出时钟。
三个选项可供选择，以减少模拟功耗为发送通道。前两个
选项禁用从传送通道A或B的输出的模拟独立地，第三个选项
禁用这两个信道的输出，并减少了一些额外的功率消耗
tional模拟支持电路最大限度地降低功耗。所有的三个选项中，偏置DAC
当前没有断电，所以恢复时间快（一般为几个时钟周期）。下面的列表
介绍了用于配置这些不同的模式和设置。
省电选项位设置[7 ： 5 ]
掉电的Tx信道模拟输出[ 1 0 0 ]
掉电的Tx B声道模拟输出[ 0 1 0 ]
掉电的Tx A和B的Tx模拟输出[1 1 1]
默认为低，这使操作该发送路径的数字部分中作为编程
通过其他寄存器。通过设置此位为高，数字模块不使用时钟来降低功耗
消费。当启用时，与Tx输出是静态的，拿着他们的最后更新值。
设置此位高功率下的芯片的接收路径的数字部分。通常情况下，任何
未使用数字模块会自动断电。
设置此寄存器位高力CLKIN2 PLL倍频到掉电状态。此模式可
可用于节省电能或绕过内部PLL 。要操作时， AD9863的PLL是
旁路， CLKIN2必须与时钟相等，以最快的Tx路径的时钟供给。
设置此寄存器位高断开与时钟路径输出的PLL 。如果PLL使能，
锁或保持锁定为正常。
无论是ADC或者两个ADC可以通过设置相应的寄存器位高断电。该
接收信道的整个模拟电路断电，其中所述差分基准，
输入缓冲器，以及内部数字块。带隙基准保持有效，以便快速
恢复。
无论是设置这些位高功率下的输入共模偏置网络的
各个信道，并且需要一个输入信号，以得到适当的直流偏置。默认情况下，这些比特是
低，并在Rx输入是自偏置到约AVDD / 2 ，并接受一个交流耦合的输入。
设置此位为高功率下降与接收路径中的所有模拟偏置电路（包括
差分基准电压缓冲器） 。因为偏压电路被关断，有一个附加的功率
节约，而且恢复时间相对于其它接收掉电选项更长。
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第6位： LSB第一
第5位：软复位
寄存器0x01 ：时钟模式
第7位至第5位： Clk_Mode
第2位：启用IFACE2 CLKOUT
第1位： INV CLKOUT （ IFACE3 ）
寄存器0x02 ：掉电
第7位至第5位：TX模拟
（掉电）
第4位：TX数码（省电）
第3位：RX数码（省电）
第2位： PLL掉电
第1位： PLL输出断接
寄存器0x03 / 04 ：RX掉电
位7： Rx_A模拟/
Rx_B模拟（省电）
第6位： Rx_A DC偏置/
Rx_B直流偏置（掉电）
寄存器0x05 ：RX掉电
第7位：接收模拟偏置（电源 -
下）
