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ORCA
OR3TP12 FPSC
嵌入式主机/目标PCI接口
数据表
2000年3月
PCI总线核心目标控制器的详细说明
（续）
表25.配置空间分配
（续）
字节
08
09—0B
0C
0D
宽度
8
24
8
8
位
—
—
—
7—3
2—0
—
—
—
—
—
—
—
—
—
—
—
—
—
—
描述
修订ID
类代码
缓存行大小
延迟定时器：
可编程部分
粒度8 CLKS
头型
BIST
基地址寄存器
Cardbus的CIS指针
子系统供应商ID
子系统ID
扩展ROM基地址
功能指针
（保留）
（保留）
断线
中断引脚
Min_Gnt
Max_Lat
读/写
只读
只读
只读
读/写
只读
只读
只读
注3
只读
只读
只读
只读
只读
只读
只读
读/写
只读
只读
只读
经过初始值
FPGA
CON组fi guration
注1
注1
零
近1
零
00h
零
注1
零
零
注1
零
50h
零
零
零
01H （ INTAN ）
注1
注1
0E
0F
10—27
28—2B
2C—2D
2E—2F
30—33
34
35—37
38—3B
3C
3D
3E
3F
8
8
192
32
16
16
32
8
24
32
9
8
8
8
1.这些数值意欲被定义分配，每预定的应用程序，通过经由所述FPGA配置管理器分配常数。
2.这些位表现出每PCI规格特殊行为：
- 读取表现正常。
- 写1清零该位为0 。
- 写0对位没有影响。
3.字节十六进制10-27包含基地址寄存器（BAR ） 。
- 内存和I / O的BAR任何合法组合是允许的，只要64位酒吧自然对齐的，也就是说，它们占据的字节
10-17 ， 18-1F ，或20-27的十六进制。
- 内存条可以被标记为可预取/ nonprefetchable通过置位/复位位3 ;然而，PCI总线核心的行为是不
受此设置。特别是，目标读操作可以丢弃，即使数据空间是未使用的FIFO中的预读数据
标记为nonprefetchable （这是不违反由于nonprefetchable位只表示的数据不能被丢弃，一旦它已经
发送的PCI总线;然而，当该位被重置必须谨慎行事） 。
4.这些信号被连接到相同的名称的FPGA的信号和不被初始化。
5.这些位表现出每个特殊的行为
CompactPCI的
热插拔规范：
- 读取表现正常。
- 写1清零该位为0 。
- 写0对位没有影响。
6.该32位寄存器的生产测试过程中使用。写操作都是不允许的;读是允许的，不会引起副作用，但是价值
返回是不确定的。
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朗讯科技公司
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