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数据表
1999年6月
ORCA
2系列的FPGA
下面的公式可以用于确定针
名称：
盘数= P [ RL ] [ TB] N± （ I X 4 ） [A - D]。
其中i = 1-8 ，和n是当前PIC的数目。
欲了解更多信息，请参考
利用
ORCA
OR2C / TxxA时钟分配网络
应用程序
阳离子注（ AP97-055FPGA ） 。
SEE细节
CLK引脚
参见B
时钟分配网络
（续）
或者，该时钟可以从脊柱被路由到
分支用而不是长行的比迪
驱动程序。这导致在时钟净增加的延迟，但
时钟偏差大约等于所述时钟
路由采用长线驱动器。此方法可以是
用于创建用于仅在一个四核的时钟
咆哮。所述XH线充当时钟脊柱，然后将其
路由使用XH垂直线（分支）
该BIDIHs 。
时钟信号，如一个计数器的输出，也可以
在PLC的产生和路由到一个XL系列，
然后充当时钟脊椎。虽然时钟
可以在任意的PLC产生，则建议
时钟尽可能靠近到FPGA的中心
以尽量减少时钟偏差。
时钟
分支机构
选择时钟输入引脚
上的任何用户I / O引脚
ORCA
FPGA可被用作
速度非常快，低偏移时钟输入。选择第一个网络时钟
销完全是任意的，但使用一个销就是近
所述装置（的边缘，如图图 - 中心
URES 34和35）将提供最低偏移时钟网络
工作。在时间的引脚对引脚进行时序数
本数据手册的特性部分假设
时钟引脚的四个太平洋岛屿之一的中心
该装置的任何一侧。
一旦连接RST时钟引脚已被选，有
只有两套针（该中心内的四个太平洋岛屿
该设备的各侧）不应该被选择为
第二时钟引脚：从同一PIC的一个销，和/或一个
销从上模的完全相反的边缘在PIC
（即，如果从顶部边缘与PIC的销被选择用于
在科幻RST时钟，在底边同PIC应
不被选择为所述第二时钟）。
VXH[3]
VXH[2]
VXH[1]
VXH[0]
时钟脊柱
PA
PB
PC
PD
DT
DT
DT
DT
这些规则应被迭代随后直至共
八个时钟（或其他全球性的信号）已
选自： 4从装置的左/右两侧，并
4 ，从该装置的顶部/底部两侧。如果有更多的
比需要八个时钟，然后选择另一个引脚
该中心外的四类PIC使用主时钟rout-
荷兰国际集团，使用辅助时钟布线的任何引脚，或使用
本地时钟布线。
如果它希望使用的销用于网络连接第一个8之一
时钟不是中心内4的PIC任何一侧的
的设备和主时钟布线的需要，该
垫名称的两个时钟引脚（见引脚信息）
在装置的顶部或底部
不能
是一个多
钳四个太平洋岛屿的路程。同样的规则也适用于时钟
在设备的左侧或右侧的引脚。
朗讯科技公司
细节A
HCK
VCK
DETAIL B
5-4481(F).r2
图35.辅助时钟分配
39
VXL[3]
VXL[2]
VXL[1]
VXL[0]
PFU
