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SPRS145J - 2000年7月 - 修订2004年11月
TMS320LF2407A ， TMS320LF2406A ， TMS320LF2403A ， TMS320LF2402A
TMS320LC2406A ， TMS320LC2404A ， TMS320LC2403A ， TMS320LC2402A
DSP控制器
引脚功能（续）
表2. LF240xA和LC240xA引脚列表和封装选项
（续）
2403A,
LC2402A
(64-PAG)
和
2402A
(64-PG)
引脚名称
LF2407A
(144-PGE)
2406A
(100-PZ)
LC2404A
(100-PZ)
描述
外部中断，时钟（续）
XINT1/IOPA2
23
16
16
外部用户中断1或GPIO 。无论XINT1和XINT2
是
沿敏感。
该
EDGE
极性
is
可编程的。 （ ↑ ）
外部用户中断2和转换的ADC启动或
GPIO 。外部“启动的转换”输入ADC / GPIO 。
无论XINT1和XINT2是边沿敏感。边缘
极性是可编程的。 （ ↑ ）
时钟输出和GPIO 。该引脚输出是CPU时钟
（ CLKOUT ）或看门狗时钟（ WDCLK ） 。选择
由系统控制的CLKSRC位（位14）制成
和状态寄存器（ SCSR ） 。该引脚可以用作GPIO
如果没有用作时钟输出引脚。 （ ↑ ）
功率驱动保护中断输入。这个中断，当
激活后，使PWM输出引脚（ EVB ）在
高阻抗状态应该电机驱动器/电源转换器
异常，如过压或过流等
出现的。 PDPINTB是一个下降沿触发中断。 （ ↑ ）
XINT2/ADCSOC/IOPD0
21
15
15
42
CLKOUT/IOPE0
73
51
51
1
PDPINTB
137
95
95
振荡器， PLL ， FLASH ，引导和杂项
XTAL1/CLKIN
123
87
87
24
PLL振荡器的输入引脚。晶振输入到PLL /时钟源
PLL的输入。 XTAL1 / CLKIN是联系在一起的参考一面
水晶。
晶振输出。 PLL的振荡器输出引脚。 XTAL2是绑
参考晶体的一侧上。该引脚变为了
高阻抗状态时EMU1 / OFF为有效低电平。
PLL电压（ 3.3 V ）
通用I / O （ ↑ ）
23
引导ROM启用， GPO ， XF 。该引脚将被作为采样
输入（ BOOT_EN ）来更新SCSR2.3 （ BOOT_EN位）
在复位，然后驱动作为输出信号XF 。后
复位， XF驱动为高电平。 ROM的装置不具有引导
ROM中，因此，没有BOOT_EN模式。该BOOT_EN销
必须被驱动，只有一个无源电路。 （ ↑ ）
XTAL2
PLLVCCA
IOPF6
BOOT_EN
BOOT_EN /
XF
XF
124
12
131
121
88
10
92
86
88
10
92
25
39
121
86
86
23
PLLF
11
9
9
38
PLL环路滤波器输入1
粗体，斜体引脚名
表示在复位后引脚功能。
GPIO - 通用输入/输出引脚。所有的GPIO拿出复位后输入。
强烈建议VCCA从（从数字地和VSSA ）的数字电源电压隔离，以保持规定的精度
并提高了ADC的噪声抑制能力。
只有当满足所有下列条件： EMU1 / OFF为低， TRST低， EMU0是高
＃无电源引脚（ VDD ， VDDO ， VSS ，或VSSO ）应悬空。所有的电源引脚都必须进行适当的连接正确
设备的操作。
图例：
↑
- 内部上拉
↓
- 内部下拉
（典型的有源上拉/下拉值
±16 A.)
14
邮政信箱1443
休斯敦，得克萨斯州77251-1443
