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飞思卡尔半导体公司
VIH
V
IH
RSTB
RST
0.2 V
DD
0.2 VDD
TwRSTB
VIL
TCSB
t
CS
V
IL
t
WRST
t
ENBL
TENBL
0.7 V
DD
0.7VDD
CS
CSB
0.7 V
DD
0.7VDD
t
Tlead
领导
t
WSCLKh
TwSCLKh
t
RSI
TRSI
VIH
V
IH
VIL
V
IL
SCLK
SCLK
0.7 V
DD
0.7VDD
0.2 V
DD
0.2VDD
t
LAG
TLAG
VIH
V
IH
VIL
V
飞思卡尔半导体公司...
t
SI （ SU ）
TSIsu
t
WSCLKl
TwSCLKl
IL
t
SI （ HOLD ）
TSI （保持）
t
TFSI
FSI
VIH
V
有效
不在乎
IH
SI
SI
不在乎
0.7 V
DD
0.7 VDD
0.2VDD
0.2 V
DD
有效
不在乎
V
IH
VIL
图5.输入时序开关特性
t
RSI
t
FSI
TRSI
3.5
3.5V
V
TFSI
VOH
V
OH
50%
1.0V
1.0 V
VOL
V
OL
SCLK
SCLK
t
SO （ EN ）
TdlyLH
SO
SO
0.7 V
DD
VDD
VOH
V
OH
VOL
V
OL
0.2 VDD
0.2 V
DD
TRSO
t
RSO
T
有效
t
有效
低到高
从低到高
SO
SO
0.7 V
DD
前高后低
高到低VDD 0.7
TfSO
t
FSO
V
OH
VOH
TdlyHL
t
SO （ DIS ）
0.2VDD
0.2 V
DD
VOL
V
OL
图6. SCLK波形和有效的SO数据延迟时间
33982
14
摩托罗拉模拟
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