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4兆位闪存LPC
SST49LF040
超前信息
表1 ：P
IN
D
ESCRIPTION
接口
TYPE
1
PP LPC功能
I
X
在读写操作输入，低位地址。地址是
在一个写周期内锁定。的编程接口，这些
地址是由R / C＃的闩锁并共享相同的引脚为高次
地址输入。
DQ
7
-DQ
0
数据
I / O
X
要在读周期输出数据，并在写周期接收输入数据。
数据在一个写周期内锁定。输出处于三态时，
OE ＃为高电平。
OE ＃
OUTPUT ENABLE
I
X
到栅极上的数据输出缓冲器。
WE＃
写使能
I
X
要控制写操作。
模式
接口
I
X
X
该引脚确定哪些接口是可操作的。当高举，程序员
模式选择
模式被激活，并保持低电平时， LPC模式被启用。该引脚必须
在设备能操作的设置在上电或复位时的回报之前不会改变
通报BULLETIN 。该引脚必须保持高电平（V
IH
）为聚丙烯模式和低（Ⅴ
IL
）为LPC模式。
INIT ＃
初始化
I
X
这是第二次复位引脚用于在系统中使用。该引脚在内部组合
与RST ＃引脚;如果此引脚或RST ＃引脚被拉低，同样的操作
展出。
ID为[ 3：0]
鉴定
I
X
这四个引脚，它允许将连接了多个部件的机构的一部分
or
输入
在同一总线。这些引脚内部上拉下来之间的电阻20-
ID为[ 3：1]
100 K
GPI [4 ：0]的
一般
I
X
这些单个输入可用于额外的电路板的灵活性。状态
通用输入
这些引脚可通过LPC寄存器读取。这些输入应在其
PCI时钟周期，在此期间读出的是开始前所需的状态
尝试，并应保持在原位，直至读周期的结束。未使用
GPI引脚不能悬空。
TBL ＃
顶块锁
I
X
当低，可以防止程序的引导扇区的块在内存顶部。
当TBL ＃为高，禁用顶块行业硬件写保护。
该引脚不能悬空。
LAD [ 3：0]的地址和
I / O
X
提供LPC的控制信号，以及地址和命令
数据
输入/输出数据。
LCLK
时钟
I
X
提供一个时钟输入到控制部
LFRAME ＃框架
I
X
以指示数据传送操作的开始;也用于中止的LPC周期
进行中。
RST ＃
RESET
I
X
X
重置设备的操作
WP ＃
写保护
I
X
当低，防止编程所有，但最高可寻址的块。
当WP ＃为高，将禁用这些模块的硬件写保护。
该引脚不能悬空。
I
X
选择编程接口，此引脚决定是否与地址
R / C＃
行/列
SELECT
销都指向了行地址，或到列地址。
水库
版权所有
X
这些引脚必须悬空。
电源
PWR X
X
提供电源（ 3.0-3.6V ）
V
DD
V
SS
地
PWR X
X
电路接地（ 0V参考）
CE＃
芯片使能
I
X
此信号必须置为选择设备。当CE＃为低时，器件
被使能。 CE ＃必须在内部写（编程或擦除）时保持低
操作。当CE＃为高电平时，器件被放置在低功率待机模式。
NC
无连接
I
X
X
未连接引脚。
符号
A
10
-A
0
引脚名称
地址
T1.4 562
1. I =输入， O =输出
2001硅存储技术公司
S71213-00-000 11/01 562
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