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HS-82C37ARH
功能说明
该HS- 82C37ARH直接存储器访问控制器是
旨在提高系统的数据传输速率
必须从一个I / O设备传送数据到存储器，或移动
的存储器块到一个I / O设备。它也将执行的MEM
储器对存储器块的移动，或网络连接LL的存储器块
从一个位置的数据。运行模式提供给
处理单字节传输，以及不连续的数据
流，这允许在HS- 82C37ARH来控制数据
移动软件的透明度。
DMA控制器是国家推动的地址和控制显
纳尔发生器，它允许数据被直接传输
从I / O设备的内存，反之亦然而没有
被存储在临时寄存器中。这样可以大大
提高数据传输速率为顺序操作，
与处理器的移动或重复的字符串比较指令
系统蒸发散。内存到内存的操作需要临时
该数据字节的代之间的内部存储
源地址和目的地址，所以存储到存储器
传输发生在I / O操作的一半以下速率
系统蒸发散，但比中央处理器技还是快很多
niques 。的最大数据传输速率与所得到的
HS- 82C37ARH是约2.5兆字节/秒，对于I / O的
操作使用的压缩时间的选择和5MHz的时钟。
在HS- 82C37ARH的方框图表示页
2.定时和控制块，优先级块，以及内部
寄存器的主要组件。图8列出了名称
和内部寄存器的大小。时序和控制
块源于时钟输入内部时序，并
产生外部控制信号。优先编码器
块解决DMA通道之间的争优先
同时请求服务。
名字
基址寄存器
基地字数寄存器
当前地址寄存器
当前字数寄存器
临时地址寄存器
临时字数注册
状态寄存器
命令寄存器
临时寄存器
模式寄存器
屏蔽寄存器
申请注册
SIZE
16位
16位
16位
16位
16位
16位
8位
8位
8位
6位
4位
4位
数
4
4
4
4
1
1
1
1
1
4
1
1
地址字节。而处于非活动状态时，控制器的输出是在一个
高阻抗状态。当由一个DMA请求启动
和总线控制是由主机， HS-放弃
82C37ARH驱动总线，并产生控制显
的NAL来执行数据传输。操作完成
通过激活的四个DMA请求输入中的一个具有previ-
ously被编入通过COM的控制器
普通话，模式，地址和字数寄存器。
例如，如果一个数据块被从RAM传送
到I / O装置，数据的起始地址被加载
到HS- 82C37ARH电流和基址寄存器
对于特定的信道，并且该块的长度是装载
进入该通道的字数注册。相应的
模式寄存器编程为一个内存到I / O操作
化（读取传输） ，以及各种选项的选择
命令寄存器等模式寄存器位。该信
NEL的屏蔽位被清除，以便识别DMA的
请求（ DREQ ） 。的DREQ可以是一个硬件信号
或一个软件命令。
一旦启动，该块DMA传送将继续作为
控制器输出的数据地址，同时MEMR
和IOW脉冲，并且选择通过DMA的I / O设备
确认（ DACK ）输出。数据字节FL OWS直接
从RAM向I / O设备。每个字节后反
ferred ，地址会自动递增（或递减
mented ）和字计数递减。操作
然后，反复进行下一个字节。控制器停止传输
当字数注册在FL OWS或数据辉凌
外部EOP施加。
为了进一步了解HS- 82C37ARH操作，状态
通过每个时钟周期产生必须加以考虑。该
DMA控制器工作在两个大周期，活动和空闲。
在编程后，控制器通常是空闲的，直到
DMA请求发生在一个未屏蔽的频道，或软
洁具的要求给出。该HS- 82C37ARH之后会要求
控制系统总线，并进入活跃周期。该
活跃周期是由几个内部状态，这取决于
荷兰国际集团对哪些选项已经被选中，是什么类型的
操作已要求。
该HS- 82C37ARH可以假设七个独立的国家，
每个组成一个完整的时钟周期。状态I （SI ）是
空闲状态。它进入时， HS- 82C37ARH没有有效
DMA请求未决，在一个传输序列的结束，或
当复位或主清除已经发生。而在SI中，
DMA控制器是不活动的，也可以是在程序有条件
灰（正被编程的处理器）。
状态0 （ S0 ）是DMA服务的第一个连接状态。该HS-
82C37ARH请求了暂停，但该处理器具有不
但返回一个应答。该HS- 82C37ARH仍觉
进行编程，直到它收到HLDA从CPU 。一
从CPU承认将信号DMA传送
可能开始。 S1，S2， S3和S4是在工作状态
DMA服务。如果需要更多的时间来完成转移
比可正常计时，等待状态（ SW ）可
通过使用不准备的S2或S3和S4之间插入
行中的HS- 82C37ARH 。
图8 。 HS- 82C37ARH内部寄存器
DMA操作
在一个系统中，在HS- 82C37ARH地址和控制输出
和数据总线管脚连接基本上与平行
系统总线。外部锁存器需要的上
规格编号
19
518058
