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飞思卡尔半导体公司
电气和热特性
3.2.3系统PLL电气特性
表10系统PLL规格
特征
SYS_XTAL频率
SYS_XTAL周期时间
SYS_XTAL时钟输入抖动
系统VCO频率
符号
f
SYS_XTAL
T
SYS_XTAL
t
抖动
f
VCOsys
t
LOCK
笔记
1
1
2
1
3
民
15.6
66.6
—
250
—
典型
33.3
30.0
—
533
—
最大
35.0
28.5
150
800
100
单位
兆赫
ns
ps
兆赫
s
SpecID
O3.1
O3.2
O3.3
O3.4
O3.5
飞思卡尔半导体公司...
系统PLL重新锁定时间
1
2
3
该SYS_XTAL频率和PLL配置位必须被选择，使得所得到的系统频率，CPU的
（芯）频率，和PLL （VCO）的频率不超过各自的最大或最小操作frequen-
资本投资者入境计划。
这代表总输入抖动 - 短期和长期相结合 - 并通过设计保证。两种不同类型的
抖动可以存在于输入到core_sysclk ，系统性和真随机抖动。真正的随机抖动被拒绝，但PLL 。
全身抖动将被传递进入并通过PLL来的内部时钟电路，直接还原的操作频
昆西。
这段时间内通过设计和特性保证。需要PLL -这段时间内的最大时间量
一个稳定的Vdd和core_sysclk之后PLL锁定在上电复位序列期间达成。此规范
也适用于当PLL已被禁用，并随后在睡眠模式下重新启用。
摩托罗拉
MPC5200硬件规格
13
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