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4GB DIMM注册
DDR SDRAM
4GB ， 512M X 72 ECC模块[ M312L5128MT0 ]
（填充的为x4的DDR SDRAM模块2行）
功能框图
V
SS
RCS1
RCS0
DQS0
DQ0
DQ1
DQ2
DQ3
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DQ4
DQ5
DQ6
DQ7
DM0/DQS9
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D0
D18
D9
D27
DQS1
DQ8
DQ9
DQ10
DQ11
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM1/DQS10
D1
D19
DQ12
DQ13
DQ14
DQ15
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D10
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D28
DQS2
DQ16
DQ17
DQ18
DQ19
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM2/DQS11
D2
D20
DQ20
DQ21
DQ22
DQ23
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D11
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D29
DQS3
DQ24
DQ25
DQ26
DQ27
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM3/DQS12
D3
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DQ28
DQ29
DQ30
DQ31
D21
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D12
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D30
DQS4
DQ32
DQ33
DQ34
DQ35
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM4/DQS13
D4
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DQ36
DQ37
DQ38
DQ39
D22
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D13
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D31
DQS5
DQ40
DQ41
DQ42
DQ43
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM5/DQS14
D5
D23
DQ44
DQ45
DQ46
DQ47
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D14
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D32
DQS6
DQ48
DQ49
DQ50
DQ51
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM6/DQS15
D6
D24
DQ52
DQ53
DQ54
DQ55
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D15
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D33
DQS7
DQ56
DQ57
DQ58
DQ59
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM7/DQS16
D7
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DQ60
DQ61
DQ62
DQ63
D25
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D16
的DQ
I / O 0
I / O 1
I / O 2
I / O 3
CS
DM
D34
DQS8
CB0
CB1
CB2
CB3
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
DM8/DQS17
D8
D26
CB4
CB5
CB6
CB7
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
D17
的DQ
I / O 3
I / O 2
I / O 1
I / O 0
CS
DM
D35
V
DDSPD
串行PD
SCL
WP
A0
CS0
CS1
BA0-BA1
A0-A13
RAS
CAS
CKE0
CKE1
WE
PCK
PCK
SPD
D0 - D35
D0 - D35
V
DD
/V
DDQ
SDA
A1
SA1
A2
SA2
VREF
V
SS
D0 - D35
D0 - D35
CK0,CK0
PLL
R
E
G
I
S
T
E
R
RCS0
RCS1
RBA0 - RBA1
RA0 - RA13
RRAS
RCAS
RCKE0
RCKE1
RWE
SA0
BA0禁令： SDRAM的D0 - D35
A0 - A13的SDRAM D0 - D35
RAS ： SDRAM的D0 - D35
CAS ： SDRAM的D0 - D35
CKE ： SDRAM的D0 - D17
CKE ： SDRAM的D18 - D35
WE： SDRAM的D0 - D35
注意事项：
1. DQ到I / O接线被示为推荐，但也可以改变。
2. DQ / DQS / DM / CKE / CS的关系必须保持，如图所示。
3. DQ ， DQS ， DM / DQS电阻： 22欧姆。
RESET
修订版0.4日。 2004年
