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TMS320VC5421
数字信号处理器
SPRS098 - DECEMBER 1999
多通道缓冲串行端口（ McBSP的） （续）
15
XCERyz15
RW,+0
7
XCERyz7
RW,+0
注意：
14
XCERyz14
RW,+0
6
XCERyz6
RW,+0
13
XCERyz13
RW,+0
5
XCERyz5
RW,+0
12
XCERyz12
RW,+0
4
XCERy4
RW,+0
11
XCERyz11
RW,+0
3
XCERyz3
RW,+0
10
XCERyz10
RW,+0
2
XCERyz2
RW,+0
9
XCERyz9
RW,+0
1
XCERyz1
RW,+0
8
XCERyz8
RW,+0
0
XCERyz0
RW,+0
R =读取，W =写， 0 =数值在复位; Y =分区A，B ， C，D ， E，F ，G或H; Z = McBSP的0,1，或2个
图12.发送通道使能寄存器位布局分区A至H
表9.发送通道使能寄存器分区为A至H
超前信息
位
15–0
名字
XCERyz （15 ：0）
功能
发送通道使能寄存器
XCERyz
n
= 0
XCERyz
n
= 1
禁止发送的
第n
通道分区年。
允许发射
第n
通道分区年。
注意：
Y =分区A，B ， C，D ， E，F ，G或H; Z = McBSP的0,1 ，或2; N = 15-0位
在McBSP的时钟停止模式（ CLKSTP ）提供了串行端口接口（ SPI ）协议兼容。
时钟停止模式仅适用单相帧，每帧一个字。受支持的字长
McBSP的是可编程的8位， 12位，16位，20 ， 24 ，或32位操作。当McBSP的配置为
工作在SPI模式，发射器和接收器一起操作作为主设备或作为从机。
McBSP的是完全静态的，工作在任意低的时钟频率。最大的McBSP多通道
对“ 5421的工作频率是10 MBps的。 Nonmultichannel操作仅限于38 MBps的。
直接存储器访问（DMA ）控制器
在' 5421包括两个6通道直接存储器存取（DMA ）控制器进行数据传输
独立于CPU ，一个用于每个子系统。 DMA控制器控制存取片外
程序/数据/ IO和内部数据/程序存储器。的' 5421的DMA控制器的主要功能是
提供代码覆盖和管理的片上存储器，所述外围设备之间的数据传输，和片外
内存。
在CPU操作的背景下， “ 5421的DMA允许内部和外部之间的数据移动
程序/数据存储器，和内部外围设备，如McBSP的和对HPI 。每一个子系统具有其自己的
独立的DMA具有六个可编程的信道，其允许对六种不同的上下文中进行DMA操作。
该HPI有一个专门的辅助DMA通道。图13示出由DMA访问的存储器映射。
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邮政信箱1443
休斯敦，得克萨斯州77251-1443
