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TMS320VC5421
数字信号处理器
SPRS098 - DECEMBER 1999
D
200 -MIPS双核DSP组成的两
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独立的子系统
每个核心具有先进的多总线
建筑和三个独立的16位
数据存储器总线和一个程序总线
40位算术逻辑单元（ ALU ）
包括一个40位的桶形移位器和两个
40位每个核心蓄电池
每个核心拥有17位
×
17位并行
乘法器耦合到40位加法器的
非流水线单周期乘法/
累加（ MAC）运算
每个核心拥有比较，选择和
存储单元（ CSSU ）的添加/比较
选择维特比算的
每个核心拥有指数编码器来
计算一个40位的指数值
在一个周期内累加器的值
每个核心拥有两个地址发生器
与8个辅助寄存器和两个
辅助寄存器算术单元
（ ARAUs ）
16位数据总线和数据总线持有人
特征
512K-Word
×
16位扩展计划
地址空间
总共256K字
×
16位双核和
单访问片内RAM （ 128K字X
16位共享内存）
单指令重复和
块重复操作
说明随着32位长的字
操作数
说明2或3操作数读
快速返回从中断
算术指令采用并行存储
和并行加载
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条件存储指令
CLKOUT的输出控制
TOUT的输出控制
功耗控制使用IDLE1 ，
IDLE2和IDLE3说明
双1.8 -V （核心）和3.3 V （ I / O）电源
耗材低功耗，快速操作
10 ns的单周期定点指令
通过两个处理器间通信
内置8元的FIFO
十二通道直接存储器访问
（ DMA）传输数据而无需CPU
加载（六通道每子系统
外部访问）
六个多通道缓冲串行端口
（ McBSP的） 128通道选择
能力（每个子系统3 McBSP的）
16位主机端口接口（ HPI ）复
与外部存储器接口引脚
软件可编程锁相环
环路（ APLL ）提供了几个时钟
选项（需要外部TTL振荡器）
包括JTAG功能进行在线
仿真
片基于扫描的仿真逻辑，
IEEE标准1149-1
{
（JTAG） Boundary-
扫描逻辑
两个软件可编程定时器
（每个子系统）
软件可编程等待状态
发电机（ 14等待美国最大）
提供144引脚微创球栅
阵列（ GGU后缀）和144引脚薄型四方
扁平封装（ TQFP ） （ PGE后缀）包
描述
在TMS320VC5421的定点数字信号处理器（DSP）是在200 MIPS的运行的双核溶液
性能。在“ 5421由两个核心能力到核心的通信和对DSP子系统
128K字零等待状态的片内程序存储器由两个DSP子系统共享。每个子系统
由一个“ 54X DSP内核， 32K字的程序/数据DARAM ， 32K字数据SARAM ， 2K字ROM ，三
多通道串行接口， XDMA逻辑，一个定时器， 1 APLL和其他杂项电路。
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