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R
XC3000系列现场可编程门阵列
从串模式
在从串行模式下，外部信号驱动CCLK
在FPGA （多个）的输入（多个） 。串行配置比特流
必须提供领先的FPGA短的DIN输入
建立时间每上升CCLK上升沿之前。铅设备
然后介绍了报头数据（以及高估的所有数据
流动的DOUT引脚上的领先设备） 。有一个内部
延迟0.5 CCLK的周期，这意味着，DOUT
在下降沿CCLK的边缘中的下一个设备的变化，并
菊花链接受对后续的上升沿数据
CCLK边缘。
*如果回读
激活时，
5 kΩ电阻
需要
系列与M1
5 k
可选
菊花链式
与生命周期评估
不同
CON连接gurations
+5 V
*
M0
微
电脑
STRB
D0
D1
I / O
PORT
D2
D3
D4
D5
D6
D7
RESET
INIT
RESET
+5 V
CCLK
DIN
M1
PWRDWN
M2
DOUT
HDC
最不发达国家
常规 -
用途
用户I / O
引脚
FPGA
其他
I / O引脚
D / P
...
7
X5993
图29 ：从串行模式电路图
1998年11月9日（版本3.1 ）
7-31
