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R
XCR3128A ： 128宏单元CPLD具有增强的时钟
表5 ：低级别ISP命令
指令
（寄存器使用）
启用
（ ISP移位寄存器）
抹去
（ ISP移位寄存器）
节目
（ ISP移位寄存器）
VERIFY
（ ISP移位寄存器）
指令码
1001
1010
1011
1100
描述
启用擦除，编程和校验命令。
擦除整个EEPROM阵列。
节目数据在ISP移位寄存器到寻址
EEPROM行。
传送从被寻址的行的数据到ISP移
注册。 。
终端
了CoolRunner XCR3128A CPLD是TotalCMOS
设备。与其它CMOS器件，重要的是要
考虑如何正确地终止未使用的输入和I / O
当引脚制造印刷电路板。允许未使用的输入
和I / O引脚悬空会导致电压是在直线
在CMOS的输入结构的区域，这可以增加
该装置的功率消耗。该XCR3128A
CPLD器件具有可编程片上下拉电阻上
每个I / O引脚。这些下拉都将自动激活
通过为所有未使用的I / O引脚的钳工软件。需要注意的是一个I / O
宏蜂窝用作掩埋逻辑不具有的I / O的
引脚用于输入被认为是未使用的，并且
下拉电阻将被导通。我们建议
在XCR3128A设备上的任何未使用的I / O引脚留
悬空。
有与无关联的片上下拉结构
专用输入引脚。赛灵思建议，任何
未使用的专用输入与外部10kΩ的终止
上拉电阻。这些引脚可以直接连接到
V
CC
或GND ，而是使用外部上拉电阻main-
tains最大的设计灵活性应未使用的一个
专用输入需要，由于未来的设计变更。
当使用JTAG / ISP的功能，这也是recom-
修补该10kΩ的上拉电阻器被上每个用于
与四个强制性JTAG信号相关联的引脚。字母
婷这些信号漂浮可引起TMS的电压
接近地面，这可能会导致设备
进入JTAG / ISP模式在不确定的时间。看到应用程序
阳离子笔记
JTAG和ISP概述赛灵思XPLA1和
XPLA2的CPLD
和
终止未使用的I / O引脚赛灵思
XPLA1和XPLA2的CoolRunner CPLD器件
了解更多信息
化。
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DS035 （ V1.2 ） 2000年8月10日
