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R
XCR3128A : 128宏单元CPLD具有增强的时钟
TotalCMOS设计技术快速零
动力
赛灵思公司是第一家提供TotalCMOS CPLD ,无论是在亲
塞斯技术和设计技术。赛灵思采用
CMOS门电路的级联来实现产品的总和
代替传统的读出放大器的方法。此CMOS
门实现允许赛灵思公司提供的CPLD这是
两个高性能和低功耗,打破了款
digm是具有低功耗,必须具有低perfor-
曼斯。请参阅
图5
和
表1
显示我
CC
与
在XCR3128A TotalCMOS CPLD的频率(数据
与8升/降电压为3.3V服用,可装载的16位计数器,
25°C).
70
60
50
40
I
CC
(MA )
30
20
10
0
1
20
40
60
频率(MHz)
80
100
120
SP00617
图5 :我
CC
与频率的关系@ V
CC
= 3.3V ,25°C
表1:我
CC
与频率的关系
(V
CC
= 3.3V , 25 ° C)
频率(MHz)
典型的我
CC
(MA )
0
0.03
1
0.7
20
12.7
40
25.5
60
38.1
80
50.5
100
62.8
120
74.7
DS035 ( V1.2 ) 2000年8月10日
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