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CY24142
引脚说明
引脚名称
XIN
V
DD
AV
DD
OE1
AV
SS
V
SSL
NC
CLK1
CLK2
OE2
V
DDL
NC
V
SS
CLK3
CLK4
XOUT
引脚数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
晶振输入。
电源电压。
模拟电源电压。
输出使能1,0 = 2 CLK和CLK3关， 1 = 2 CLK和CLK3上;
内部弱
下拉。
模拟地。
V
DDL
地面上。
无连接;
离开浮动。
13.5 MHz的时钟输出。
54 MHz的时钟输出;
通过OE1控制。
输出使能2,0 = CLK4关， 1 = CLK4上;
内部弱上拉了下来。
电源电压。
无连接;
离开浮动。
地面上。
18.432 MHz的缓冲基准输出，
通过OE1控制。
18.432 MHz的缓冲基准输出，
通过OE2控制。
晶振输出。
引脚说明
布局建议
在X
IN
和X
OUT
迹线和焊盘以及晶体
应放在远离任何时钟走线或噪声源。
噪声耦合到X
IN
和X
OUT
痕迹可能会导致
启动问题。焊盘的接地电阻应敷设
出的X
OUT
痕量在必要时可以塞，以防
启动问题发生。
文件编号： 38-07532牧师* B
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