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PD488448的牧师P
19.控制寄存器的交易
RDRAM中具有两个CMOS输入引脚SCK和CMD和两个CMOS输入/输出管脚SIO0和SIO1 。这些
提供串行访问在RDRAM的一组控制寄存器。这些控制寄存器提供的配置
信息来在初始化过程中的控制器。他们也允许应用来选择适当的
在RDRAM的操作模式。 SCK （串行时钟）和CMD （命令） ，通过控制装置驱动以所有RDRAMs
并联。 SIO0和SIO1从一个RDRAM的连接（菊花链的方式）到下一个。在正常
操作中，对SIO0数据上重复SIO1 ，它连接到下一个的RDRAM SIO0 （该数据被重复
从SIO1到SIO0用于读出的数据包） 。所述控制器连接到所述第一RDRAM的SIO0 。
读写事务分别由四包，如图19-1和图19-2 。每
数据包由16位组成，如表20-1和表20-2 。包位进行采样在下降
SCK的边缘。事务始于SRQ （串行请求）数据包。此分组与11110000框
在CMD输入模式（注意， CMD位进行采样两个下降沿和SCK的上升沿） 。
该SRQ包包含SOP3..SOP0 （串行指令代码）字段，选择交易类型。该
SDEV5..SDEV0 （串行设备的地址），选择32 RDRAMs之一。如果SBC （串行广播）被设置，则所有
RDRAMs被选中。在SA （串口地址）数据包包含一个12位地址，用于选择控制寄存器。
写事务有一个SD（串行数据）数据包下一步。这包含了16位数据被写入到所选择的
控制寄存器。一个SINT （串行间隔）数据包是最后提供一些延迟对于任何副作用的发生。一
读事务有SINT数据包，然后一个SD数据包。这提供延迟选定RDRAM的访问
控制寄存器。在SD从其它读取的数据在相反方向上的分组行进（朝控制器）
数据包类型。在SCK周期时间将可容纳的总延迟。
图19-1串行写入（ SWR ）交易到控制寄存器
SCK
T
4
T
20
T
36
T
52
T
68
1
0
CMD
1111 0000
下一交易
00000000...00000000
00000000...00000000
00000000...00000000
00000000...00000000
1111
1
0
1
SIO0
SRQ - SWR命令
SA
SD
圣马丁
SIO1
每个分组被重复
从SIO0到SIO1
SRQ - SWR命令
SA
SD
圣马丁
0
1
0
图19-2串行读（ SRD ）事务控制寄存器
SCK
T
4
T
20
T
36
T
52
T
68
1
0
CMD
1111 0000
下一交易
1
1111
00000000...00000000
00000000...00000000
00000000...00000000
解决RDRAM设备
0 / SD15..SD0 /上SIO0 0
00000000...00000000
控制器的驱动器
0 SIO0
0
1
0
SIO
0
SRQ - SRD命令
SA
圣马丁
0
SD
SIO
1
第3包重复
从SIO0到SIO1
SRQ - SRD命令
SA
圣马丁
0
不解决RDRAMs通
0 / SD15..SD0 / 0从SIO1到SIO0
0
1
0
SD
0
数据表M14837EJ3V0DS00
33
