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IDT 79RC32355
锁相环（PLL）的
该处理器使用内部锁相环对齐管道时钟， PClock ，到主输入时钟（ CLKP ） （PLL ）电路， gener-
阿泰对齐的时钟。本质上， PLL电路只能在有限生成一致的时钟输入主时钟（ CLKP ）频率
范围内。
PLL模拟滤波器
所需的锁相环电路中的存储电容器包含在RC32355 。然而，我们建议，该系统
设计者提供无源元件为PLL电源的滤波网络。
V
CC
P（ PLL电路电源）和V
SS
P（ PLL电路接地）应该从V隔离
CC
核心（核心力）和V
SS
（共同地）与过滤器
电路，例如图22中所示的那个。
因为该过滤器组件的最佳值取决于应用和系统噪声的环境中，这些值应该是
作为出发点，为您的特定应用程序中进一步的实验。
10欧姆
1
VCC
10
F
VSS
0.1
F
100 pF的
VSSP
RC32355
VCCP
1.
这个电阻可以要求在嘈杂环境中的电路。
图22 PLL滤波器电路的噪声环境
推荐运行温度和电源电压
GRADE
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产业
1
温度
0 ° C至+ 70 ° C环境
-40 °C至+ 85 ° C环境
VSS
1
VSSP
5
0V
0V
V
cc
I / O
2
3.3V±5%
3.3V±5%
V
cc
CORE
3
V
cc
P
4
2.5V±5%
2.5V±5%
2
VCCI / O的I / O电源。
VSS提供一个共同的基础。
3
VccCore的内在逻辑力量。
4
VCCP是锁相环功率。
5
VSSP是锁相环地面。
表17温度和电压
容性负载降额
参阅
RC32355 IBIS模型
它可以在IDT网站（ www.idt.com ）中找到。
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2004年5月25日
