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IDT
TM
INTERPRISE
TM
集成
通信处理器
79RC32355
功能列表
RC32300 32位微处理器
- 增强型MIPS -II ISA
- 增强型MIPS - IV高速缓存预取指令
- DSP指令
- MMU具有16项TLB
- 8KB指令缓存, 2路组相联
- 2KB数据缓存, 2路组相联
- 每行缓存锁定
- 写式和回写高速缓存管理
- 通过EJTAG端口调试接口
- 大和little endian支持
中断控制器
- 允许每一个状态中断读取和屏蔽
2
IC
- 灵活的I
2
C标准的串行接口连接到各种
外设
- 标准和快速模式时序的支持
- 可配置的7位或10位寻址的从
个UART
- 两个16550兼容的UART
- 波特率支持高达1.5 Mb / s的
计数器/定时器
- 三个通用32位计数器/定时器
通用I / O引脚( GPIOP )
- 36个可单独编程引脚
- 每个引脚可编程为输入,输出或复用功能
- 输入可以作为一个中断或NMI源
- 输入也可以是高电平或低电平有效
SDRAM控制器
- 2内存银行,非交错式, 512 MB总
- 32位宽的数据通路
- 支持4位, 8位和16位宽的SDRAM芯片
- SODIMM支持
- 撑之间传输网页上
- 自动刷新代
外围设备控制器
- 26位地址总线
- 具有可变宽度支持的8位,16位或32位的32位数据总线
- 8位引导ROM支持
- 6银行提供,高达64MB银行
- 支持闪存ROM,PROM, SRAM,双端口存储器,并
外围设备
- 支持外部等待状态的产生, Intel或Motorola风格
- 写保护功能
- 直接控制,可选的外部数据收发器
系统完整性
- 可编程系统看门狗定时器的复位时间系统
OUT
- 可编程总线事务次的存储器和外设
交易产生的超时热复位
DMA
- 16个DMA通道
- 芯片和外围服务
- 支持内存到内存,内存到I / O和I / O到I / O
转帐
- 支持通过灵活的基于描述符的操作和链接
记录链表(分散/聚集能力)
- 支持非对齐传输
- 支持突发传输
框图
RC32300
CPU核心
ICE
EJTAG
D.高速缓存
MMU
一,高速缓存
3计数器
计时器
看门狗
定时器
打断
调节器
:
:
10/100
ETHERNET
接口
USB
接口
16通道
DMA
调节器
ARBITER
分机。公共汽车
SDRAM &
设备
调节器
I
2
C
调节器
2个UART
(16550)
GPIO
接口
TDM
接口
自动取款机
接口
内存&
外设总线
I
2
C总线
CH 。 1章。 2
串行通道
GPIO引脚
TDM总线
乌托邦1月2日
图1 RC32355内部框图
IDT和IDT标识是注册为Integrated Device Technology , Inc.的商标。
1 47
2004年集成设备技术有限公司
2004年5月25日
DSC 5900
IDT 79RC32355
USB
- 版本1.1兼容
- USB从设备控制器
- 支持6
th
USB端点
- 在12 Mb / s的全速运转
- 支持控制,中断,批量和同步端点
- 支持USB远程唤醒
- 集成的USB收发器
TDM
- 串口时分复用( TDM )语音和数据接口
- 提供接口,电话编解码器和DSP
- 界面以高质量的音频位A / D和D /与外部
胶合逻辑
- 支持1到128个8位时隙
- 兼容朗讯CHI , GCI ,敏迪ST总线, K2和SLD
公共汽车
- 支持高达8.192 Mb / s的数据传输速率
- 支持内部或外部帧生成
- 支持多个不连续的有源输入和输出的时间
老虎机
EJTAG
- 运行时模式提供了一个标准的JTAG接口
- 实时模式提供了额外引脚用于实时跟踪
信息
ETHERNET
- 为10和100 Mb的全双工支持/ s以太网
- IEEE 802.3u标准兼容的媒体独立接口( MII )
与串行管理接口
- IEEE 802.3u自动协商,自动速度选择
- 灵活的地址过滤模式
- 64项基于哈希表的多播地址过滤
ATM SAR
- 可配置为一个乌托邦水平1接口或1
UTOPIA第2级接口与2根地址线( 3 PHY的最大值)
- 支持25MB / s和更快的自动取款机
- 支持速度高达UTOPIA数据路径界面操作
到33 MHz的
- 支持标准的53字节的ATM信元
- 执行HEC生成和检查
- 细胞处理丢弃短细胞和剪辑长细胞
- 16细胞身价缓冲
- 乌托邦模式: 8单元格中输入缓冲器和8单元的输出缓冲器
- 对于CRC- 32新一代硬件的支持,并检查
AAL5
- 对于CRC- 10生成和检查硬件支持
- 虚拟缓存机制获得支持接收任何
无需CPU干预对多达八个simulta-长包
neously主动接收通道
- 帧模式传输机制支持的传输
无需CPU干预的任何长度的数据包
系统特点
- JTAG接口( IEEE 1149.1兼容)
- 208引脚PQFP封装
- 2.5V内核电源和3.3V的I / O供电
- 高达180兆赫管道次数高达75 MHz的总线
频率
RC32300 CPU核心
调试端口
计时器
UART
中断CTL
DMA
频道
USB至PC
回声
编解码器
SLIC
USB
TDM
数据缓冲区
SDRAM CTL
内存&
I / O控制器
ATM I / F
以太网MAC
MII I / F
以太网收发器
POTS电话
RJ11
以太网PC
时钟
32位数据总线
SDRAM
内存& I / O
传输
收敛
数据泵
AFE
xDSL的家庭网关图2示例使用RC32355
2 47
2004年5月25日
IDT 79RC32355
设备概述
该RC32355是一种含有高perfor- “片上系统”。
曼斯的32位微处理器。该微处理器内核使用exten-
sively在设备的心脏,以落实最需要的
功能的软件以最小的硬件支持。高
高性能微处理器处理多样化的通用计算任务
而这将需要特定的应用任务的专用硬件
洁具。在软件中实现特定的应用任务可包括
路由功能,防火墙功能,调制解调器仿真, ATM SAR
仿真,等等。
该RC32355满足各种嵌入式commu-要求
通信业和数字消费应用。它是一个单芯片解决方案
即采用最通用的系统功能和应用的
化特定的接口,使产品快速进入市场,成本非常低
系统,简化了设计,减少了电路板空间。
CPU核心的执行
该RC32355是围绕RC32300 32位高性能
微处理器内核。该RC32300实现了增强型MIPS- II
ISA和有助于满足实时的目标和吞吐量最大化的
通过提供的功能,例如通讯和消费电子系统
在预取指令,多DSP指令和高速缓存锁定。
DSP指令使RC32300实现33.6和
56Kbps的调制解调器功能的软件,消除了对外部
专用硬件。缓存锁定保证了实时性能
通过举办重要的DSP代码和参数缓存中立即
可用性。微处理器还实现了一个片上的MMU与
TLB中,使得其完全兼容的实时要求
操作系统。
内存和I / O控制器
该RC32355集成了一个灵活的存储和外围设备
控制器提供SDRAM ,闪存ROM , SRAM支持,双口
存储器,以及其它I / O设备。它可以直接连接到8位引导
ROM,用于非常低的成本系统的实施。它可以访问
非常高的带宽外部存储器( 380 MB /秒的峰值)在非常低的
系统的成本。它还提供了各种权衡成本/性能
主存储器架构。在RC32355实现的计时器
满足大多数RTOS的要求。
DMA控制器
DMA控制器从移动中数据偏离加载CPU芯
片上的接口,外围设备,和存储器。在DMA
控制器支持分散/聚集DMA没有对齐限制,
适用于通信和图形系统。
TDM总线接口
该RC32355集成了行业标准的TDM总线接口
直接访问外部设备,如电话的编解码器和
品质音频位A / D和D /为。此功能对于应用的关键,如
如电缆调制解调器和xDSL调制解调器,需要沿着传送语音
用数据来支持IP语音的能力。
以太网接口
该RC32355包含一个片上以太网MAC能力的10和
100 Mbps的线路接口与MII接口。它支持多达4个MAC
地址。在SOHO路由器,高性能RC32300 CPU核心
路由以太网和ATM接口之间的数据。在其他
应用,如高速调制解调器,以太网接口可以是
用来连接到PC。
USB设备接口
该RC32355包括业界标准的USB设备接口
使家电消费直接连接到电脑。
ATM SAR
该RC32355包括一个可配置的ATM信特区,支持
UTOPIA 1级或UTOPIA 2级界面。在ATM SAR是imple-
mented作为软件和硬件的混合体。硬件模块
提供了必要的低水平块(如CRC生成和
检查和细胞的缓冲),而软件被用于上级
SARing功能。在xDSL调制解调器应用中, UTOPIA接口端口
直接面对到的xDSL芯片组。在SOHO路由器或线路卡一
三层交换机,它提供了访问ATM网络。
对于ICE增强型JTAG接口
对于低成本的在线仿真( ICE ) ,该RC32300 CPU核心
包括增强型JTAG ( EJTAG )接口。这种接口由
两种操作模式:运行时模式和实时模式。
运行时模式提供了一个标准的JTAG接口芯片
调试和实时模式下提供了额外的状态插脚式
PCST〔 2:0] -which被一起使用JTAG引脚为实
在处理器内部时钟的时间跟踪信息或任何分裂
管道时钟。
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2004年5月25日
IDT 79RC32355
散热注意事项
该RC32355功耗小于2.5瓦的峰值功率。这是瓜拉尼
开球在0℃至+ 70℃的商用一个环境温度范围
温度的设备和 - 40 °C至+ 85 °,工业级温度
设备。
修订历史
2001年3月29日:
初始发布。
2001年9月24日:
去除引用DPI接口。
去掉引用“边沿触发中断输入”的GPIO引脚。
从DP改为208针封装的型号来DH 。
2001年10月10日:
在表5,6订正的AC定时特性,
7,8, 10,12,和15在表18中, “直流电气特修订值
开创性意义“ ;表20 , “ RC32355功耗” ;图23 ,
“典型的用电量。 ”改变的数据表,从初稿到最后。
2001年10月23日:
修订后的图23中的“典型用电量。 ”
2001年11月1日:
加入的输入电压下冲参数
一个脚注表21 。
2002年1月30日:
在表6中,变化的值从1.5到1.2的
下列信号: MDATA Tdo1 , MADDR Tdo2 , CASN Tdo3 , CKENP
Tdo4 , BDIRN Tdo5 , BOEN Tdo6 。
2002年5月20日:
表20更改后的值,功率消耗。
2002年9月19日:
加入COLDRSTN TRISE1参数表
5 ,复位和系统的交流时序特性。
2002年12月6日:
在功能部分,改变了UART的速度从
115 KB / s到1.5 Mb / s的。
2002年12月17日:
加V
OH
参数表18 ,直流Elec-
Trical公司特点。
2004年1月27日:
增加了180MHz的速度等级。
2004年5月25日:
在表7中,信号MIIRXCLK和MIITXCLK ,所述敏
和最大值为
10
Mbps的Thigh1 / tLOW1结束分别改为140和
260分别与最小值和最大值为100 Mbps的Thigh1 /
tLOW1结束分别变为14.0和26.0 。
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2004年5月25日
IDT 79RC32355
引脚说明表
下面的表列出了设置在RC32355的引脚的功能。一些列出的功能可以被复用到相同的引脚。
定义一个信号的有效极性,一个后缀将被使用。用的“N”结束的信号应该被解释为是活动的,或者认定时,在时
一个逻辑零(低)电平。所有其他信号(包括时钟,总线和选择线)将处于逻辑1被解释为活性,或置位,当
(高)级。
注意:
该RC32355输入焊盘不包含内部上拉或下拉电阻。未使用的输入应连接关闭以适当的水平。
这是未使用的控制信号输入(如BRN ) ,如果悬空,可能产生不利的RC32355的操作影响尤为关键
化。此外,任何输入引脚悬空会导致功耗稍有增加。
名字
系统
CLKP
COLDRSTN
RSTn低电平有效
I
I
I / O
输入
的STi
1
系统时钟输入。
这是系统主时钟输入。该RISCore 32300管道频率的倍数(×2 , ×3 ,或
X4该时钟频率) 。所有其他逻辑运行在这个频率以下。
冷复位。
这个信号低的断言启动冷复位。这会导致初始化RC32355状态,开机
配置被加载,而内部处理器的PLL锁定到系统时钟( CLKP ) 。
类型I / O类型
描述
低驱动
复位。
这种双向信号或者驱动为低电平或三态,外部上拉被要求提供高状态。该
与STI RC32355驱动器复位时RSTN低(以告知复位正在进行外部系统),然后三态吧。
外部系统可以驱动RSTN低启动热复位,然后要三态吧。
高驱动
系统时钟输出。
这是系统时钟输入( CLKP )的缓存和延迟版本。所有的SDRAM交易
是同步的该时钟。该引脚必须从外部连接到SDRAM的和给RC32355 SDCLKINP销
( SDRAM时钟输入) 。
[ 21:0]的高
存储器地址总线。
26位地址总线,用于存储器和外围设备的访问。 MADDR [ 20时17分]被用于
DRIVE
SODIMM数据掩模使得如果选择的SODIMM模式。
[ 25:22 ]低MADDR [22]主要功能:通用I / O, GPIOP [ 27 ] 。
驾驶MADDR [23]主要功能:通用I / O, GPIOP [ 28 ] 。
的STi
MADDR [24]主要功能:通用I / O, GPIOP [ 29 ] 。
MADDR [25]主要功能:通用I / O, GPIOP [ 30 ] 。
SYSCLKP
O
内存和外设总线
MADDR [25 :0]的
O
MDATA [31 :0]的
BDIRN
BOEN [1 :0]的
I / O
O
O
高驱动
存储器数据总线。
32位数据总线,用于存储器和外围设备的访问。
高驱动
外部缓冲器的方向。
外部收发器的方向控制为所述存储器和外围数据总线, MDATA [31:0 ] 。它
在任何读事务为低电平,并保持在写事务高。
高驱动
外部缓冲器输出使能。
这些信号提供两个输出允许外部数据总线收发器上的控制
存储器和外围数据总线, MDATA 。 BOEN [0]是在外部设备中读取数据置为低电平。 BOEN [1]
为低电平时SDRAM读取事务。
的STi
外部总线请求。
该信号为低电平由外部主设备要求内存的所有权,
外设总线。
BRN
BGN
WAITACKN
I
O
I
低驱动
外部总线格兰特。
该信号为低电平由RC32355 ,表示RC32355已放弃所有权
本地存储器和外设总线到外部主机。
的STi
等待或传输确认。
当配置为等待,该信号的存储器和外围设备时置位为低
设备的总线事务以延长总线周期。当配置为传输确认,此信号为低电平能很好地协同
荷兰国际集团的存储器和外围设备的总线事务对信号完成的交易。
CSN [5:0 ]
O
[3:0]
设备的片选。
这些信号被用来选择在设备中的存储器和外围总线的外部设备
高驱动交易。在访问到所选择的外部设备中的每个位被置为低电平。
CSN [4]主要功能:通用I / O, GPIOP [ 16 ] 。
[5:4]
CSN [5]主要功能:通用I / O, GPIOP [ 17 ] 。
低驱动
表1引脚说明(第8第1部分)
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IDT
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INTERPRISE
TM
集成
通信处理器
79RC32355
功能列表
RC32300 32位微处理器
- 增强型MIPS -II ISA
- 增强型MIPS - IV高速缓存预取指令
- DSP指令
- MMU具有16项TLB
- 8KB指令缓存, 2路组相联
- 2KB数据缓存, 2路组相联
- 每行缓存锁定
- 写式和回写高速缓存管理
- 通过EJTAG端口调试接口
- 大和little endian支持
中断控制器
- 允许每一个状态中断读取和屏蔽
2
IC
- 灵活的I
2
C标准的串行接口连接到各种
外设
- 标准和快速模式时序的支持
- 可配置的7位或10位寻址的从
个UART
- 两个16550兼容的UART
- 波特率支持高达1.5 Mb / s的
计数器/定时器
- 三个通用32位计数器/定时器
通用I / O引脚( GPIOP )
- 36个可单独编程引脚
- 每个引脚可编程为输入,输出或复用功能
- 输入可以作为一个中断或NMI源
- 输入也可以是高电平或低电平有效
SDRAM控制器
- 2内存银行,非交错式, 512 MB总
- 32位宽的数据通路
- 支持4位, 8位和16位宽的SDRAM芯片
- SODIMM支持
- 撑之间传输网页上
- 自动刷新代
外围设备控制器
- 26位地址总线
- 具有可变宽度支持的8位,16位或32位的32位数据总线
- 8位引导ROM支持
- 6银行提供,高达64MB银行
- 支持闪存ROM,PROM, SRAM,双端口存储器,并
外围设备
- 支持外部等待状态的产生, Intel或Motorola风格
- 写保护功能
- 直接控制,可选的外部数据收发器
系统完整性
- 可编程系统看门狗定时器的复位时间系统
OUT
- 可编程总线事务次的存储器和外设
交易产生的超时热复位
DMA
- 16个DMA通道
- 芯片和外围服务
- 支持内存到内存,内存到I / O和I / O到I / O
转帐
- 支持通过灵活的基于描述符的操作和链接
记录链表(分散/聚集能力)
- 支持非对齐传输
- 支持突发传输
框图
RC32300
CPU核心
ICE
EJTAG
D.高速缓存
MMU
一,高速缓存
3计数器
计时器
看门狗
定时器
打断
调节器
:
:
10/100
ETHERNET
接口
USB
接口
16通道
DMA
调节器
ARBITER
分机。公共汽车
SDRAM &
设备
调节器
I
2
C
调节器
2个UART
(16550)
GPIO
接口
TDM
接口
自动取款机
接口
内存&
外设总线
I
2
C总线
CH 。 1章。 2
串行通道
GPIO引脚
TDM总线
乌托邦1月2日
图1 RC32355内部框图
IDT和IDT标识是注册为Integrated Device Technology , Inc.的商标。
1 47
2004年集成设备技术有限公司
2004年5月25日
DSC 5900
IDT 79RC32355
USB
- 版本1.1兼容
- USB从设备控制器
- 支持6
th
USB端点
- 在12 Mb / s的全速运转
- 支持控制,中断,批量和同步端点
- 支持USB远程唤醒
- 集成的USB收发器
TDM
- 串口时分复用( TDM )语音和数据接口
- 提供接口,电话编解码器和DSP
- 界面以高质量的音频位A / D和D /与外部
胶合逻辑
- 支持1到128个8位时隙
- 兼容朗讯CHI , GCI ,敏迪ST总线, K2和SLD
公共汽车
- 支持高达8.192 Mb / s的数据传输速率
- 支持内部或外部帧生成
- 支持多个不连续的有源输入和输出的时间
老虎机
EJTAG
- 运行时模式提供了一个标准的JTAG接口
- 实时模式提供了额外引脚用于实时跟踪
信息
ETHERNET
- 为10和100 Mb的全双工支持/ s以太网
- IEEE 802.3u标准兼容的媒体独立接口( MII )
与串行管理接口
- IEEE 802.3u自动协商,自动速度选择
- 灵活的地址过滤模式
- 64项基于哈希表的多播地址过滤
ATM SAR
- 可配置为一个乌托邦水平1接口或1
UTOPIA第2级接口与2根地址线( 3 PHY的最大值)
- 支持25MB / s和更快的自动取款机
- 支持速度高达UTOPIA数据路径界面操作
到33 MHz的
- 支持标准的53字节的ATM信元
- 执行HEC生成和检查
- 细胞处理丢弃短细胞和剪辑长细胞
- 16细胞身价缓冲
- 乌托邦模式: 8单元格中输入缓冲器和8单元的输出缓冲器
- 对于CRC- 32新一代硬件的支持,并检查
AAL5
- 对于CRC- 10生成和检查硬件支持
- 虚拟缓存机制获得支持接收任何
无需CPU干预对多达八个simulta-长包
neously主动接收通道
- 帧模式传输机制支持的传输
无需CPU干预的任何长度的数据包
系统特点
- JTAG接口( IEEE 1149.1兼容)
- 208引脚PQFP封装
- 2.5V内核电源和3.3V的I / O供电
- 高达180兆赫管道次数高达75 MHz的总线
频率
RC32300 CPU核心
调试端口
计时器
UART
中断CTL
DMA
频道
USB至PC
回声
编解码器
SLIC
USB
TDM
数据缓冲区
SDRAM CTL
内存&
I / O控制器
ATM I / F
以太网MAC
MII I / F
以太网收发器
POTS电话
RJ11
以太网PC
时钟
32位数据总线
SDRAM
内存& I / O
传输
收敛
数据泵
AFE
xDSL的家庭网关图2示例使用RC32355
2 47
2004年5月25日
IDT 79RC32355
设备概述
该RC32355是一种含有高perfor- “片上系统”。
曼斯的32位微处理器。该微处理器内核使用exten-
sively在设备的心脏,以落实最需要的
功能的软件以最小的硬件支持。高
高性能微处理器处理多样化的通用计算任务
而这将需要特定的应用任务的专用硬件
洁具。在软件中实现特定的应用任务可包括
路由功能,防火墙功能,调制解调器仿真, ATM SAR
仿真,等等。
该RC32355满足各种嵌入式commu-要求
通信业和数字消费应用。它是一个单芯片解决方案
即采用最通用的系统功能和应用的
化特定的接口,使产品快速进入市场,成本非常低
系统,简化了设计,减少了电路板空间。
CPU核心的执行
该RC32355是围绕RC32300 32位高性能
微处理器内核。该RC32300实现了增强型MIPS- II
ISA和有助于满足实时的目标和吞吐量最大化的
通过提供的功能,例如通讯和消费电子系统
在预取指令,多DSP指令和高速缓存锁定。
DSP指令使RC32300实现33.6和
56Kbps的调制解调器功能的软件,消除了对外部
专用硬件。缓存锁定保证了实时性能
通过举办重要的DSP代码和参数缓存中立即
可用性。微处理器还实现了一个片上的MMU与
TLB中,使得其完全兼容的实时要求
操作系统。
内存和I / O控制器
该RC32355集成了一个灵活的存储和外围设备
控制器提供SDRAM ,闪存ROM , SRAM支持,双口
存储器,以及其它I / O设备。它可以直接连接到8位引导
ROM,用于非常低的成本系统的实施。它可以访问
非常高的带宽外部存储器( 380 MB /秒的峰值)在非常低的
系统的成本。它还提供了各种权衡成本/性能
主存储器架构。在RC32355实现的计时器
满足大多数RTOS的要求。
DMA控制器
DMA控制器从移动中数据偏离加载CPU芯
片上的接口,外围设备,和存储器。在DMA
控制器支持分散/聚集DMA没有对齐限制,
适用于通信和图形系统。
TDM总线接口
该RC32355集成了行业标准的TDM总线接口
直接访问外部设备,如电话的编解码器和
品质音频位A / D和D /为。此功能对于应用的关键,如
如电缆调制解调器和xDSL调制解调器,需要沿着传送语音
用数据来支持IP语音的能力。
以太网接口
该RC32355包含一个片上以太网MAC能力的10和
100 Mbps的线路接口与MII接口。它支持多达4个MAC
地址。在SOHO路由器,高性能RC32300 CPU核心
路由以太网和ATM接口之间的数据。在其他
应用,如高速调制解调器,以太网接口可以是
用来连接到PC。
USB设备接口
该RC32355包括业界标准的USB设备接口
使家电消费直接连接到电脑。
ATM SAR
该RC32355包括一个可配置的ATM信特区,支持
UTOPIA 1级或UTOPIA 2级界面。在ATM SAR是imple-
mented作为软件和硬件的混合体。硬件模块
提供了必要的低水平块(如CRC生成和
检查和细胞的缓冲),而软件被用于上级
SARing功能。在xDSL调制解调器应用中, UTOPIA接口端口
直接面对到的xDSL芯片组。在SOHO路由器或线路卡一
三层交换机,它提供了访问ATM网络。
对于ICE增强型JTAG接口
对于低成本的在线仿真( ICE ) ,该RC32300 CPU核心
包括增强型JTAG ( EJTAG )接口。这种接口由
两种操作模式:运行时模式和实时模式。
运行时模式提供了一个标准的JTAG接口芯片
调试和实时模式下提供了额外的状态插脚式
PCST〔 2:0] -which被一起使用JTAG引脚为实
在处理器内部时钟的时间跟踪信息或任何分裂
管道时钟。
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2004年5月25日
IDT 79RC32355
散热注意事项
该RC32355功耗小于2.5瓦的峰值功率。这是瓜拉尼
开球在0℃至+ 70℃的商用一个环境温度范围
温度的设备和 - 40 °C至+ 85 °,工业级温度
设备。
修订历史
2001年3月29日:
初始发布。
2001年9月24日:
去除引用DPI接口。
去掉引用“边沿触发中断输入”的GPIO引脚。
从DP改为208针封装的型号来DH 。
2001年10月10日:
在表5,6订正的AC定时特性,
7,8, 10,12,和15在表18中, “直流电气特修订值
开创性意义“ ;表20 , “ RC32355功耗” ;图23 ,
“典型的用电量。 ”改变的数据表,从初稿到最后。
2001年10月23日:
修订后的图23中的“典型用电量。 ”
2001年11月1日:
加入的输入电压下冲参数
一个脚注表21 。
2002年1月30日:
在表6中,变化的值从1.5到1.2的
下列信号: MDATA Tdo1 , MADDR Tdo2 , CASN Tdo3 , CKENP
Tdo4 , BDIRN Tdo5 , BOEN Tdo6 。
2002年5月20日:
表20更改后的值,功率消耗。
2002年9月19日:
加入COLDRSTN TRISE1参数表
5 ,复位和系统的交流时序特性。
2002年12月6日:
在功能部分,改变了UART的速度从
115 KB / s到1.5 Mb / s的。
2002年12月17日:
加V
OH
参数表18 ,直流Elec-
Trical公司特点。
2004年1月27日:
增加了180MHz的速度等级。
2004年5月25日:
在表7中,信号MIIRXCLK和MIITXCLK ,所述敏
和最大值为
10
Mbps的Thigh1 / tLOW1结束分别改为140和
260分别与最小值和最大值为100 Mbps的Thigh1 /
tLOW1结束分别变为14.0和26.0 。
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2004年5月25日
IDT 79RC32355
引脚说明表
下面的表列出了设置在RC32355的引脚的功能。一些列出的功能可以被复用到相同的引脚。
定义一个信号的有效极性,一个后缀将被使用。用的“N”结束的信号应该被解释为是活动的,或者认定时,在时
一个逻辑零(低)电平。所有其他信号(包括时钟,总线和选择线)将处于逻辑1被解释为活性,或置位,当
(高)级。
注意:
该RC32355输入焊盘不包含内部上拉或下拉电阻。未使用的输入应连接关闭以适当的水平。
这是未使用的控制信号输入(如BRN ) ,如果悬空,可能产生不利的RC32355的操作影响尤为关键
化。此外,任何输入引脚悬空会导致功耗稍有增加。
名字
系统
CLKP
COLDRSTN
RSTn低电平有效
I
I
I / O
输入
的STi
1
系统时钟输入。
这是系统主时钟输入。该RISCore 32300管道频率的倍数(×2 , ×3 ,或
X4该时钟频率) 。所有其他逻辑运行在这个频率以下。
冷复位。
这个信号低的断言启动冷复位。这会导致初始化RC32355状态,开机
配置被加载,而内部处理器的PLL锁定到系统时钟( CLKP ) 。
类型I / O类型
描述
低驱动
复位。
这种双向信号或者驱动为低电平或三态,外部上拉被要求提供高状态。该
与STI RC32355驱动器复位时RSTN低(以告知复位正在进行外部系统),然后三态吧。
外部系统可以驱动RSTN低启动热复位,然后要三态吧。
高驱动
系统时钟输出。
这是系统时钟输入( CLKP )的缓存和延迟版本。所有的SDRAM交易
是同步的该时钟。该引脚必须从外部连接到SDRAM的和给RC32355 SDCLKINP销
( SDRAM时钟输入) 。
[ 21:0]的高
存储器地址总线。
26位地址总线,用于存储器和外围设备的访问。 MADDR [ 20时17分]被用于
DRIVE
SODIMM数据掩模使得如果选择的SODIMM模式。
[ 25:22 ]低MADDR [22]主要功能:通用I / O, GPIOP [ 27 ] 。
驾驶MADDR [23]主要功能:通用I / O, GPIOP [ 28 ] 。
的STi
MADDR [24]主要功能:通用I / O, GPIOP [ 29 ] 。
MADDR [25]主要功能:通用I / O, GPIOP [ 30 ] 。
SYSCLKP
O
内存和外设总线
MADDR [25 :0]的
O
MDATA [31 :0]的
BDIRN
BOEN [1 :0]的
I / O
O
O
高驱动
存储器数据总线。
32位数据总线,用于存储器和外围设备的访问。
高驱动
外部缓冲器的方向。
外部收发器的方向控制为所述存储器和外围数据总线, MDATA [31:0 ] 。它
在任何读事务为低电平,并保持在写事务高。
高驱动
外部缓冲器输出使能。
这些信号提供两个输出允许外部数据总线收发器上的控制
存储器和外围数据总线, MDATA 。 BOEN [0]是在外部设备中读取数据置为低电平。 BOEN [1]
为低电平时SDRAM读取事务。
的STi
外部总线请求。
该信号为低电平由外部主设备要求内存的所有权,
外设总线。
BRN
BGN
WAITACKN
I
O
I
低驱动
外部总线格兰特。
该信号为低电平由RC32355 ,表示RC32355已放弃所有权
本地存储器和外设总线到外部主机。
的STi
等待或传输确认。
当配置为等待,该信号的存储器和外围设备时置位为低
设备的总线事务以延长总线周期。当配置为传输确认,此信号为低电平能很好地协同
荷兰国际集团的存储器和外围设备的总线事务对信号完成的交易。
CSN [5:0 ]
O
[3:0]
设备的片选。
这些信号被用来选择在设备中的存储器和外围总线的外部设备
高驱动交易。在访问到所选择的外部设备中的每个位被置为低电平。
CSN [4]主要功能:通用I / O, GPIOP [ 16 ] 。
[5:4]
CSN [5]主要功能:通用I / O, GPIOP [ 17 ] 。
低驱动
表1引脚说明(第8第1部分)
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2004年5月25日
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