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ADSP-BF531/ADSP-BF532/ADSP-BF533
串行外设接口（SPI ）端口
- 主时序
表27
和
图19
描述SPI端口主操作。
表27.串行外设接口（ SPI ） - 主时序
参数
时序要求
t
SSPIDM
数据输入有效到SCK边沿（数据输入建立）
t
HSPIDM
SCK采样边沿到数据输入无效
开关特性
t
SDSCIM
SPISELx低到第一个SCK边沿（ X = 0或1 ）
t
SPICHM
串行时钟高周期
t
SPICLM
串行时钟低电平时间
t
SPICLK
串行时钟周期
t
HDSM
最后一个SCK边沿SPISELx高（ X = 0或1 ）
连续传输延迟
t
SPITDM
t
DDSPIDM
SCK边沿到数据输出有效（数据输出延迟）
t
HDSPIDM
SCK边沿到数据输出无效（数据输出保持）
民
7.5
–1.5
2t
SCLK
–1.5
2t
SCLK
–1.5
2t
SCLK
–1.5
4t
SCLK
–1.5
2t
SCLK
–1.5
2t
SCLK
–1.5
0
–1.0
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
6
4.0
SPISELx
（输出）
t
SDSCIM
SCK
（ CPOL = 0 ）
（输出）
t
SPICHM
t
SPICLM
t
SPICLK
t
HDSM
t
SPITDM
t
SPICLM
SCK
（ CPOL = 1 ）
（输出）
t
SPICHM
t
DDSPIDM
MOSI
（输出）
CPHA=1
MISO
（输入）
最高位
t
HDSPIDM
最低位
t
SSPIDM
MSB VALID
t
HSPIDM
t
SSPIDM
LSB VALID
t
HSPIDM
t
DDSPIDM
MOSI
（输出）
CPHA=0
MISO
（输入）
最高位
t
HDSPIDM
最低位
t
SSPIDM
MSB VALID
t
HSPIDM
LSB VALID
图19.串行外设接口（ SPI ） - 主时序
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分页： 56 33 | 2004年3月
