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2004年4月5日
16
飞利浦半导体
注册
SYNC_DIS
ADR R / W
19H W
RESET
000
0000
D7
D6
mdd_dvi_
on
D5
mdd_cs_
sog_en
D4
mdd_hs_
regen_on
D3
D2
iif_dvi_on
D1
D0
XGA双输入佛罗里达州的面板控制器
iif_cs_sog_ iif_hs_
en
regen_on
PLL编程： 20H到29H
CD_PLL_CTRL
CD_PLL_P_HI
CD_PLL_P_LO
CD_PLL_HI
CD_PLL_LO
CD_LPLL_HI
CD_LPLL_LO
CD_LPLL_PHA
CD_LPLL_PD
CD_PLL_LOCK
20H W
21H W
22H W
23H W
24H W
25H W
26H W
27H W
28H W
29H
010 000
00H
00H
00
0000
00H
00
0000
00H
0
0000
100
0000
XXX
相
AUTO
相
SELECT
line_pll_n_div [7 ：0]的
line_pll_phase [4 ：0]的
pd_pll_phase [4 ：0]的
相
INLOCK
PLL_Inlock
llpll_inlock
pll_n_div [7 ：0]的
line_pll_m_div [1 ：0]的
line_pll_n_div [11：8 ]
line_pll_
HS_POL
pll_pre_div [15：8 ]
pll_pre_div [7 ：0]的
pll_m_div [1 ：0]的
pll_n_div [11：8 ]
line_pll_
VS_POL
line_pll_en
pll_src
pll_pre_
DIV_EN
PLL_EN
接口时序： 34H和35H
IT_CTRL
IT_PLL
记
1， X =无关。
表8
ADC CON组fi guration和DVI / HDCP寄存器（第1页） ;注1
ADR R / W
RESET
000
00H
00H
00H
adc_red_brightness [7 ：0]的
adc_red_contrast [7 ：0]的
adc_green_brightness [7 ：0]的
D7
D6
D5
D4
D3
D2
D1
D0
产品speci fi cation
34H W
35H W
01
1111
1111
TMDS_
SELECT
相
por_pol
dvi_por_pol dvi_pon_
POL
pll_coast_
POL
adc_pon_
POL
bigger_
out_pol
pll_pon_pol llpll_coast_ llpll_pon_
POL
POL
注册
ADC编程： 00H到06H
ADC_CTRL
ADC_R_BRI
ADC_R_CON
ADC_G_BRI
00H W
01H W
02H W
03H W
sog_vs_
关闭
版权所有
sync_on_
GREEN_EN
SAA6713H
