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SX -A系列FPGA
输出缓冲器延迟
E
D
TRIBUFF
PAD
为了交流测试负载（如下图所示）
V
CC
In
OUT
V
OL
t
DLH
图2-4
输出缓冲器延迟
V
CC
GND
1.5 V
En
OUT
50% 50%
V
CC
1.5 V
V
OL
t
ENZL
GND
10%
t
ENLZ
En
OUT
GND
V
CC
50%
50%
1.5 V
t
ENZH
t
ENHZ
GND
90%
50% 50%
V
OH
1.5 V
AC测试负载
负载1
（用于测量
传播延迟）
到输出
被测
35 pF的
负载2
（用于测量启用延迟）
V
CC
GND
R键V
CC
对于T
PZL
R键GND对于T
PZH
R = 1kΩ的
35 pF的
负载3
（用于测量禁用延迟）
V
CC
GND
R键V
CC
对于tPZL
R键GND为tPZH
R = 1kΩ的
5 pF的
到输出
被测
到输出
被测
图2-5
AC测试负载
v5.1
2-15
