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SN65LV1021/SN65LV1212
10 MHz至40 MHz时， 10 ： 1 LVDS串行器/解串器
SLLS526F - 2002年2月 - 修订2002年11月
时序图和测试电路（续）
解串器
CMOS / TTL输出
tTLH （ C）
80%
20%
80%
20%
TTHL （L）的
15 pF的
图5.解串器CMOS / TTL输出负载和转换时间
TT （CLK）
TCLK
90%
10%
90%
10%
TT （CLK）
3V
0V
图6.串行输入时钟跳变时间
TTCP
TCLK
1.5 V
1.5 V
1.5 V
对于TCLK_R / F =低
TSU （ DI ）
DIN [9：0 ]
1.5 V
格局
HOLD
第（ DI）的
1.5 V
图7.串行建立/保持时间
寄生包装和
走线电容
3V
DEN
0V
TD （ HZ ）
DO +
13.5
1.1 V
DO -
DEN
13.5
DO
±
TD （ LZ ）
50%
VOL
VOH
50%
50%
1.1 V
TD （ ZL ）
1.1 V
50%
TD （ ZH ）
1.5 V
1.5 V
图8.串行高阻态测试电路和时序
12
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达拉斯，德克萨斯州75265
