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CY7C1381C
CY7C1383C
CY7C1381C引脚定义
（续）
名字
ADSC
TQFP
(3-Chip
启用）
85
BGA
(1-Chip
启用）
B4
FBGA
(3-Chip
启用）
A8
I / O
描述
输入 -
地址选通脉冲从控制器，采样
同步
在CLK ，低电平有效的上升沿。
当置为低电平，地址介绍
到设备中捕获的地址
寄存器。一
[1:0]
也被加载到爆
计数器。当ADSP和ADSC都
断言，只有ADSP是公认的。
输入 -
字节写使能输入，低电平有效。
同步采样在CLK的上升沿。这
信号必须被拉低进行
字节写。
输入 -
ZZ “休眠”输入，高电平有效。
当
异步置为高电平，将器件置于一个
非时间关键“休眠”状态的数据
完整地保存下来。对于正常操作，
该引脚为低电平或悬空。 ZZ引脚
有一个内部上拉下来。
I / O-
双向数据I / O线。
作为输入使用时，它们
同期进到一个芯片上的数据寄存器是
由CLK的上升沿触发。如
输出，它们提供包含在数据
由所指定的存储器位置
在先前提出的地址
时钟上升沿读周期。的方向
该引脚是通过OE控制。当OE
低电平时，引脚用作输出。
当HIGH ， DQ
s
和DQP
[A ：D ]
放置
在一个三态condition.The输出
数据过程中自动三态
写序的部分，在第一
时钟从取消的时候出现
状态，并且所述装置的选择取消时，
不管OE的状态。
I / O-
双向数据奇偶校验I / O线。
同步在功能上，这些信号是相同的
DQ
s
。在写序列， DQP
[A ：D ]
is
通过控制体重
[A ：D ]
水涨船高。
输入静态
选择爆秩序。
当连接到GND
选择线性突发序列。当绑
V
DD
或悬空选择交错爆裂
序列。这是一个带针和应
留在器件工作期间是静态的。模式
引脚具有内部上拉电阻。
BWE
87
M4
A7
ZZ
64
T7
H11
DQ
s
52,53,56,57,58,
59,62,63,68,69,
72,73,74,75,78,
79,2,3,6,7,8,9,
12,13,18,19,22,
23,24,25,28,29
K6 ， L6 ， M6 ， N6 ， K7 M11 ， L11 ， K11 ，
J11,J10,K10,
,L7,N7,P7,E6,F
6 ，G6， H6 ，D7， E7， L10， M10 ，D10，
G7 ， H7 ， D1 ， E1 ，G E10 ， F10 ， G10 ，
1 ， H 1， E 2 ，F 2 ，G 2， D11 ， E11 ，F11，
G11,D1,E1,
H2,K1,L1,N1,P1
F1,G1,D2,E2,
,K2,L2,M2,N2
F2,G2,J1,K1,
L1,M1,J2,
K2,L2,M2,
DQP
[A ：D ]
51,80,1,30
P6,D6,D2,P2
N11,C11,C1,N1
模式
31
R3
R1
V
DD
15,41,65,91
J2,C4,J4,R4,J6
D4,D8,E4,
E8,F4,F8,
G4,G8,H4,
H8,J4,J8,
K4,K8,L4,
L8,M4,M8
电源
电源输入的核心
装置。
文件编号： 38-05238牧师* B
第36 7
