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HYS72D[128/256][300/320/321/500][GBR/HR]-[5/6/7/7F]-B
录得双数据速率SDRAM模块
引脚配置
2
表3
符号
引脚配置
引脚定义和功能
TYPE
功能
地址输入
银行选择
数据输入/输出
校验位（ × 72组织只）
指令输入
时钟使能
SDRAM的低数据选通信号
差分时钟输入
SDRAM的低数据掩码/
高数据选通信号
芯片选择
电源（ +2.5 V）
地
I / O驱动器电源
VDD评判识别标志
EEPROM的电源
I / O基准源
串行总线时钟
串行总线的数据线
从地址选择
无连接
不使用
复位引脚（部队寄存器输入低）
1)
A0 - A11,A12
BA0 ， BA1
DQ0 - DQ63
CB0 - CB7
RAS ， CAS ， WE
CKE0 ， CKE1
DQS0 - DQS8
CK0 ， CK0
DM0 - DM8
DQS9 - DQS17
S0 - S1
V
DD
V
SS
V
DDQ
V
DDID
V
DDSPD
V
REF
SCL
SDA
SA0 - SA2
NC
DU
RESET
1）电源和电源管理上的DDR Registered DIMM内存模组的详细描述，请参见应用笔记的
该数据表的末尾
数据表
8
修订版0.5 ， 2003-12
