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ADSP-2185L
设计一个EZ- ICE-兼容的系统
在ADSP- 2185L具有片上仿真支持和冰
端口，一组特殊的引脚接口EZ -ICE的。这些
特征允许在电路内仿真而无需更换目标
通过仅使用一个从14针连接系统处理器
目标系统到EZ -ICE 。目标系统必须有一个14针
连接器接受EZ -ICE在电路探头，一个14针插头。
看到ADSP -2100系列EZ-工具数据手册完整IN-
形成的冰品。
发行芯片复位命令时仿真使
DSP的执行完全芯片复位，包括其存储器的复位
模式。因此，至关重要的是，模式引脚设置正确
在此之前，从仿真器的用户发出一个芯片复位命令
界面。如果您使用的是保持一种被动方法
模式信息（如设置存储模式讨论）
然后不要紧，该模式信息由锁存
仿真器复位。但是，如果你使用的是
RESET
引脚
设定的模式引脚的值的方法，那么你必须
考虑到仿真器复位的影响。
确保位于模式中的值的一种方法
引脚被那些期望的是构造如同所示的一个电路
图9.本电路迫使位于A模式的价值
引脚为逻辑高电平;不管它通过锁定
RESET
or
EReset
引脚。
EReset
RESET
在EZ -ICE通过带状电缆连接到目标系统
和一个14针母插头。带状电缆为10英寸
长度，其一端固定到EZ -ICE 。女性插头
插到上的14针连接器（针带的头）
目标板。
目标板连接器EZ -ICE探头
在EZ -ICE的连接器（一个标准销带报头）中示出
图10.您必须将此连接添加到您的目标板
设计，如果你打算使用EZ- ICE 。请务必留出足够的
房间在您的系统以适应EZ -ICE探测到14针
连接器。
1
GND
3
EBG
2
BG
4
BR
6
EINT
5
EBR
7
8
ELIN
KEY （无引脚）
9
ELOUT
10
ECLK
11
EE
12
EMS
13
RESET
14
EReset
顶视图
ADSP-2185L
1k
MODE A / PFO
图10.目标板连接器EZ -ICE
可编程I / O
图9.模式的引脚/ EZ -ICE电路
14引脚， 2排针带标头锁定式设计，在针脚某些地区7
化，必须从标题中删除引脚7 。该引脚必须
为0.025英寸见方，至少0.20英寸的长度。销spac-
ING应该是0.1
×
0.1英寸。销带的头必须有
至少有0.15英寸的间隙各方接受的EZ -ICE
探头插头。
销带标头是可以从供应商如3M ，
麦肯齐和Samtec公司。
目标存储器接口
在ICE - Port接口由以下ADSP- 2185L的
引脚：
EBR
EMS
ELIN
EBG
EINT
ELOUT
EReset
ECLK
EE
这些ADSP - 2185L引脚都必须连接
只
到EZ -ICE
连接器在目标系统。这些引脚的功能没有EX-
仿真过程概念，并且不需要上拉或下拉
电阻器。痕迹的ADSP- 2185L之间，这些信号
和连接器必须保持尽可能的短，不再
比三英寸。
下面的引脚也可以由EZ -ICE ：
BR
RESET
BG
GND
为你的目标系统必须与EZ -ICE兼容仿效
荡器，它必须符合所列出的存储器接口指南
下文。
PM ， DM ， BM ，国际移民组织和CM
设计你的程序存储器（ PM ） ，数据存储器（ DM ） ，
字节的存储器（ BM ） ， I / O存储器（ IOM ）和复合
存储器（CM ）的外部接口，以符合最坏的情况下
器件的时序要求和开关特性
在DSP的数据手册中规定。的性能
EZ -ICE可向公布最坏情况下的规范
一些存储器访问时序要求和开关
的特点。
注意：如果目标没有达到最坏的情况下芯片规格
重刑内存访问参数，你可能无法
仿真的电路在所需CLKIN的频率。 DE-
等候规范违规的严重程度，你可以
有麻烦制造系统的DSP组件
统计学开关特性和时序变化要求一
公布的范围内求。
在EZ -ICE使用EE （模拟器使能）信号采取CON-
控制的ADSP- 2185L在目标系统中。这将导致
处理器使用其
ERESET ， EBR
和
EBG
销，而不是
RESET ， BR
和
BG
销。该
BG
输出为三态的。这些
信号不需要进行跳线分离系统。
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REV 。一
