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ADSP-2186L
共模引脚
针
姓名(或名称)
RESET
BR
BG
BGH
DMS
PMS
IOMS
血粉
CMS
RD
WR
IRQ2/
PF7
IRQL0/
PF5
IRQL1/
PF6
IRQE /
PF4
PF3
模式C /
PF2
模式B /
PF1
模式A /
PF0
CLKIN , XTAL
CLKOUT
SPORT0
SPORT1
IRQ1 : 0
FI , FO
PWD
PWDACK
FL0 , FL1,FL2
V
DD
GND
V
DD
GND
EZ-端口
2
1
5
5
1
1
#
输入/
of
OUT-
把针
功能
1
1
1
1
1
1
1
1
1
1
1
1
I
I
O
O
O
O
O
O
O
O
O
I
I / O
I
I / O
I
I / O
I
I / O
I / O
I
I / O
I
I / O
I
I / O
I
O
I / O
I / O
处理器复位输入
总线请求输入
格兰特总线输出
公交格兰特洪输出
数据存储器选择输出
程序存储器选择输出
内存选择输出
字节的存储器选择输出
内存组合选择输出
存储器读使能输出
内存写使能输出
边沿或电平检测
中断请求
1
可编程I / O引脚
电平触发中断请求
1
可编程I / O引脚
电平触发中断请求
1
可编程I / O引脚
边沿触发的中断请求
1
可编程I / O引脚
可编程I / O引脚
模式选择输入核对
仅在
RESET
可编程I / O引脚在
正常工作
模式选择输入核对
仅在
RESET
可编程I / O引脚在
正常工作
模式选择输入核对
仅在
RESET
可编程I / O引脚在
正常工作
时钟或石英晶体输入
处理器时钟输出
串行端口I / O引脚
串行端口I / O引脚
边沿或电平敏感中断,
标志,标志out
2
关断控制输入
断电控制输出
输出FL AGS
功率( LQFP )
地( LQFP )
功率(迷你BGA)的
地面(迷你BGA )
对于使用仿真
3
内存接口引脚
在ADSP- 2186L处理器可在两种模式下使用:
完整的内存模式,它允许BDMA操作全
叠加的外部存储器和I / O能力,或主机模式,这
允许IDMA操作限制外部寻址capabili-
关系。操作模式是通过的C模式的状态决定
在销
RESET
在处理器和不能改变
在运行。 (见表VI完整模式操作说明。 )
完整的内存模式引脚(模式C = 0 )
引脚名称
A13:0
D23:0
#
of
引脚
14
24
输入/
产量
O
I / O
功能
地址输出引脚亲
克,数据字节和I / O空间
数据I / O引脚的计划,
数据字节和I / O空间
( 8个MSB也可用作
字节的内存地址)
1
1
1
1
1
主机模式引脚(模式C = 1 )
引脚名称
IAD15 : 0
A0
D23:8
IWR
税务局
IAL
IS
IACK
#
of
引脚
16
1
16
1
1
1
1
1
输入/
产量
I / O
O
I / O
I
I
I
I
O
功能
IDMA端口地址/数据总线
地址引脚用于外部I / O ,
程序,数据或字节访问
数据I / O引脚的计划,
数据字节和I / O空间
IDMA写使能
IDMA读使能
IDMA地址锁存器引脚
IDMA选择
IDMA口确认
在主机模式下,外部设备的地址可以使用A0解码,
CMS , PMS , DMS
和
IOMS
信号。
终止未使用引脚
下表显示了用于终止建议
未使用的引脚。
引脚端接
针
名字
XTAL
CLKOUT
A13: 1或
IAD12 : 0
A0
D23:8
D7或
IWR
D6或
税务局
D5或
IAL
I / O
3-State
(Z)
I
O
O( Z)
I / O ( Z)
O( Z)
I / O ( Z)
I / O ( Z)
I
I / O ( Z)
I
I / O ( Z)
I
RESET
状态
I
O
高阻
高阻
高阻
高阻
高阻
I
高阻
I
高阻
I
HI- Z *
造成
By
未使用
CON组fi guration
FL燕麦
FL燕麦
FL燕麦
FL燕麦
FL燕麦
FL燕麦
FL燕麦
高(无效)
FL燕麦
高(无效)
FL燕麦
低(无效)
1
1
3
6
10
11
20
9
I
O
O
I
I
I
I
I / O
BR , EBR
IS
BR , EBR
BR , EBR
BR , EBR
BR , EBR
BR , EBR
笔记
1
中断/标志引脚保留这两种功能同时使用。如果IMASK被设置为
使能相应的中断,DSP将跳转到相应的
中断向量地址时,该引脚置位,或者通过外部设备或
设置为可编程标志。
2
由DSP系统控制寄存器决定SPORT配置。软
洁具配置。
3
请参见本数据手册的完整设计的EZ -ICE兼容系统
信息。
–4–
版本B