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P L I M I N A R
（ISA周期）+ （DMA周期）+（低速）
2个CPU时钟
0
2个CPU /本地
总线时钟
高速锁相环（我
4
)
1
÷
2
18.432
9.216
18.432兆赫
DIVIDE
链
4.608
2.304
1.152
I
4
I
3
I
2
I
1
I
0
S
[1:0]
可编程低速（我
0
–I
3
)
（低速PLL模式）
÷
2
S
2
÷
4
国内
系统时钟
DMA
时钟
外
系统时钟
图2中。
时钟控制框图
52
ELAN SC300 微控制器数据表
