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AD9433
图9是用于时钟信号的另一个优选的方法
AD9433 。时钟源（低抖动）从单转换
结束使用RF变压器差动。背面对背面
在变压器二次限时钟肖特基二极管
闯AD9433约0.8 V峰峰值differ-
无穷区间。这有助于防止时钟的大电压摆动
从通过向AD9433的其它部分供给，并
限制呈现给ENCODE输入噪声。晶体
时钟振荡器也可使用，如果以驱动所述射频变压器
适当的限流电阻（通常为100
)
被放置在
系列与主。
0.1 F
100
T1–4T
艾因
50
类似物
信号
来源
1:1
25
25
艾因
0.1 F
图11.变压器耦合模拟输入电路
时钟
来源
ENCODE
AD9433
ENCODE
HMS2812
二极管
图9.变压器耦合编码电路
ENCODE电压等级定义
驱动ENCODE电压等级的定义和
ENCODE
在单端和差分模式显示
在图10中。
表一ENCODE输入
在最高频率的应用，两个变压器CON组
连接的串联可能是必要的，以减少偶次
谐波失真。第一个将变压器隔离和反对
用vert信号为差分信号，但在接地输入上
初级侧会降低幅度平衡的二线
ARY绕组。绕组的原因的电容耦合
这种不平衡。因为一个输入到所述第一变压器是
接地的，很少有或没有电容耦合，从而产生一个
在第一变压器的输出幅度失配。第二个
变压器将改善振幅平衡，从而
改进的谐波失真。一个宽带变压器，例如
从微型电路的ADT1-1WT ，推荐
这些应用中，作为带宽通过两个变压器
将被降低
√2.
艾因
50
类似物
信号
来源
1:1
1:1
25
25
艾因
0.1 F
AD9433
描述
最小标称最大
750毫伏
5.5 V
V
CC
+ 0.5 V
3.750 V
4.25 V
差分信号幅度200mV的
(V
ID
)
输入电压范围
–0.5 V
(V
IHD
, V
ILD
, V
IHS
, V
ILS
)
内部共模偏置
(V
ICM
)
外部的共模偏置2.0 V
(V
ECM
)
图12.驱动模拟输入与两个变压器
对于改进的偶次谐波
驱动ADC的单端形式会降低性能，
特别是偶次谐波。为了获得最佳的动态性能，
阻抗为AIN和
艾因
应该匹配。
要特别注意，在模拟输入部分的设计
在AD9433中，以防止数据时的损伤和腐败
输入是过载。
SFDR优化
ENCODE
ENCODE
V
IHD
V
ICM
, V
ECM
V
ILD
ENCODE
ENCODE
0.1 F
V
IHS
V
ICM
, V
ECM
V
ILS
该SFDR MODE引脚使能（SFDR MODE = 1） propri-
etary电路，可改善无杂散动态范围
在AD9433的（ SFDR ）性能。它在应用中是有用
其中，该系统的动态范围是由离散的有限
引起的在ADC的非线性寄生频率内容
传递函数。
启用此电路会给电路动态转移
功能，即两者之间的电压阈值
相邻输出代码可以从时钟周期改变时钟
周期。同时改善杂散频率成分这一点，
动力的传递函数的方面可能是不合适
对于转换器的一些时域的应用程序。连
的SFDR MODE引脚接地将禁用此功能。该
该数据表的典型性能曲线部分说明
在变流器及其影响的线性度提高
对无杂散动态范围（ TPC 1 ， 2 ， 15 ， 18 ） 。
图10.差分和单端输入电平
模拟量输入
模拟输入到AD9433是差分缓冲器。
输入缓冲器是自偏置由一个片上的电阻分压器
名义上设置直流共模电压为4 V（见
等效电路部分） 。额定才能达到最佳性能
通过差分驱动输入。最小输入偏移电压
从一个源与一个低差分驱动时，得到
源阻抗，例如变压器，在交流应用
行动（参见图11） 。在输入端电容耦合会
增加输入偏移电压高达50毫伏。
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第0版
