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15:12
描述
写片选德断言（英特尔型接口） 。定义数
[3：0 ]＃引脚是当LBCS基准周期之后的时钟周期
去断言（高）的写操作本地总线中。
1
读未写在写周期（摩托罗拉型德断言
接口）。定义了时钟周期的数目的基准周期后
当LBRDWR ＃引脚拉高（高）写入到本地时
总线。
1
读控制断言（英特尔型接口） 。定义的数量
当LBRD ＃引脚被置为基准周期后的时钟周期
（低）时，从本地总线读取。
1
读数据选通断言（摩托罗拉型接口） 。定义
[ 3：0] ＃时钟周期的参考周期，当个发光二极管后的数
引脚在从本地总线读断言（低） 。
1
读控制去断言（英特尔型接口） 。定义的数量
参考周期后，时钟周期时LBRD ＃引脚为DE-
在从本地总线读断言（高） 。
1
读数据选通德断言（摩托罗拉型接口） 。定义
[ 3：0] ＃时钟周期的参考周期，当个发光二极管后的数
引脚被拉高（高电平）时从本地总线读取。
1
写控制断言（英特尔型接口） 。定义的数量
当LBWR ＃引脚被置为基准周期后的时钟周期
（低）写入到本地总线中。
1
写数据选通断言（摩托罗拉型接口） 。定义
[ 3：0] ＃时钟周期的参考周期，当个发光二极管后的数
引脚被写入到本地总线时有效（低） 。
1
写控制去断言（英特尔型接口） 。定义的数量
参考周期后，时钟周期时LBWR ＃引脚为DE-
在写本地总线时有效（高） 。
1
写数据选通德断言（摩托罗拉型接口） 。定义
[ 3：0] ＃时钟周期的参考周期，当个发光二极管后的数
引脚被拉高（高）在写周期的局部总线。
1
注1 ：
OX16PCI954
读/写
EEPROM
RESET
PCI
RW
2h
W
19:16
W
RW
0h
（ 1H的
并行端口）
23:20
W
RW
3h
（ 2H的
并行端口）
27:24
W
RW
0h
（ 1H的
并行端口）
31:28
W
RW
2h
在0H阿（ 0-10十进制）的范围内唯一值是有效的。其他值保留。这些参数适用于8位和32位本地总线
配置。请参阅下页的笔记。
数据表修订版1.3
第21页
