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COP8CBR9/COP8CCR9/COP8CDR9
9.0引脚说明
（续）
寻址空间有独立的地址总线。该架构设计师用手工
tecture ，但基于哈佛架构，许可证
从Flash存储器的数据传送到RAM 。
10.1 CPU寄存器
CPU可以做一个8位的加法，减法，逻辑或移位
在一个指令的操作（叔
C
）的周期时间。
有六种CPU寄存器：
A是8位累加寄存器
PC是15位的程序计数器寄存器
聚氨酯是高7位程序计数器（PC）的
PL为低8位程序计数器（PC）的
B是一个8位RAM地址的指针，其可以是任选
后自动递增或递减。
X是一个8位的备用RAM的地址指针，它可以是
可选择发布自动递增或递减。
S是8位的数据段地址寄存器用于扩展
的地址范围的下半部分（ 00至7F）成256个数据
每128字节段。
SP为8位的堆栈指针，它指向的子程序/
中断堆栈（ RAM中） 。带复位的SP被初始化
RAM地址06F十六进制。该SP递减的项目
压入堆栈。 SP指向下一个可用的某些地区
化堆栈上。
所有的CPU寄存器的内存映射的例外
化的累加器（ A）和程序计数器（ PC）中。
10.2程序存储器
程序存储器由32,768字节的闪存
内存。这些字节可以存放程序指令或CON-
常量数据（对于下岗指令数据表，跳载体
为JID指令，中断了VIS矢量
指令）。程序存储器是由15位寻址
程序计数器（PC ） 。在设备矢量所有的中断
程序存储器单元00FF十六进制。程序存储器
在擦除状态读取00进制。开始执行程序
在位置0复位后。
如果在SP中包含6F返回指令被执行
（十六进制） ，指令执行将继续从程序
内存位置7FFF （十六进制） 。如果位置7FFF被访问
取指令，所述闪存将返回一个值
00.这是操作码的INTR指令，将导致
一个软件陷阱。
擦除和重写闪存的目的，
它的组织中的128字节的页面。
10.3数据存储器
该数据存储器的地址空间包括片上RAM
和数据寄存器， I / O寄存器（配置，数据和
脚），控制寄存器， MICROWIRE / PLUS SIO移位
注册和各种寄存器和计数器相关
与计时器和USART的（除的
空闲定时器） 。数据存储是通过在 - 直接处理
梁支或间接地由B，X和SP指针。
该数据存储器包括1024个字节的RAM。十六
内存字节地址0F0为被映射为“登记”
0FF十六进制。这些寄存器可以立即被加载，并
也降低，并且与DRSZ （减量试验
注册并跳过如果为零）指令。该内存指针
寄存器X， SP ，B和S的存储器映射到该空间
在地址位置0FC到0FF六角分别与
其它寄存器被用于一般用途。
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图5： I / O端口配置 - 输入模式
9.1仿真连接
连接到仿真系统通过2 ×7制成
连接器，中断复位， G0的连续性，
G1中，所述COP8装置和之间G2和G3的信号
目标系统（如图中的其余部分
图6）。
这CON-
接器可被设计成生产印刷电路板和可
通过跳线或信号线被替换时，仿真是
没有必要的时间。仿真器将复制的所有功能
的G0 - G3和复位。为了正常工作，没有任何联系
应在仿真器上的装置侧进行连接
器。
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图6.仿真连接
10.0功能描述
该装置的结构是一种改性的哈佛架构
tecture 。与哈佛结构，程序存储器
（闪光灯）是分开的数据存储存储器（RAM） 。两
程序存储器和数据存储器有自己独立的
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