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系统设计信息
额外的功率消耗,但是地址总线上拉电阻不neccessary的器件正常工作。窥探
地址和传输属性输入为: A [ 0时31 ] , AP [ 0 : 3 ] , TT [ 0 : 4 ] , TBST和GBL 。
的数据总线输入的接收机通常被关闭时,没有读操作正在进行中,因此,不
需要拉总线上的电阻。系统中的其他数据总线接收器,不过,可能需要上拉,或
这些信号可以另外由系统在非活动期间由系统驱动。数据总线信号是:
DH [ 0时31分] ,DL- [ 0时31 ] ,和DP [ 0:7] 。
如果选择32位数据总线模式下,未使用的数据和奇偶校验位的输入接收器将被禁用,并且其
输出将驱动逻辑0时,原本正常驱动他们。对于这种模式,这些引脚不
需要上拉电阻,并应悬空的系统,以尽量减少可能的输出开关。
如果地址或数据的奇偶校验不被系统使用,并且各个奇偶校验是通过HID0禁用,则
输入接收器的引脚被禁用,并且这些引脚不需要上拉电阻,应保持
由系统未连接状态。如果所有的奇偶校验产生是通过HID0禁用,则所有的奇偶校验检查也应
通过HID0被禁用,所有的奇偶校验引脚可以由系统悬空。
二级接口不需要上拉电阻。
8.7
JTAG配置信号
边界扫描测试是通过JTAG接口信号的功能。的TRST信号是可选的在IEEE
1149.1规范,而是提供了实现了PowerPC架构的所有处理器。虽然可以
仅使用TCK和TMS信号,迫使TAP控制器复位状态,更可靠的上电复位
如果TRST信号在上电复位断言性能获得。由于JTAG接口
还用于访问公共片上处理器(COP)功能,只需捆扎TRST到HRESET是不
实用。
这些处理器的COP功能允许一个远程计算机系统(典型地,具有专用硬件中的计算机
和调试软件)来访问和控制处理器的内部操作。在COP接口连接
主要是通过处理器的JTAG端口,一些附加的状态的监控信号。缔约方会议端口
要求能够独立地断言HRESET或TRST为了完全控制处理器的能力。如果目标
系统具有独立的复位源,如电压监测器,看门狗定时器,电源故障,或
按钮开关,则COP复位信号必须被合并到这些信号的逻辑。
在所示的布置
图24
允许COP端口独立断言HRESET或TRST ,同时确保
该目标可以驱动HRESET为好。如果JTAG接口和COP头将不会被使用, TRST应
绑通过一个0 Ω隔离电阻HRESET ,以便它被置位时,系统复位信号( HRESET )是
断言确保JTAG扫描链上电时初始化。虽然飞思卡尔建议
COP头被设计到系统中,如图
图24中的
如果这是不可能的,所述隔离电阻将允许
到TRST将来访问在一个JTAG接口可能需要的情况下进行布线到系统调试的情况。
在显示的COP头
图24
增加了许多好处,断点,观察点,寄存器和存储器
检查/修改,和其它标准的调试器的功能是可能的,通过这个接口,并可以作为
在需要的时候便宜作为未填充的足迹为标题中所添加的。
缔约方会议接口具有基于0.025"方交0.100"用于连接到目标系统的标准报头,
中心插头组件(通常称为伯格头)。连接器通常具有销14移除的连接器
键。
MPC755 RISC微处理器硬件规格,版本6.1
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飞思卡尔半导体公司

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