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集成
电路
系统公司
产品数据表
M902-01
VCSO B
ASED
G
B
权证
LOCK
G
enerator
P
IN
A
SSIGNMENT
（ 9 ×9mm的SMT）的
XTAL_1 / REF_IN
GND
停止
EXT_CLK
EN_EXT_CLK
NC
NC
NC
VCC
27
26
25
24
23
22
21
20
19
G
ENERAL
D
ESCRIPTION
的M902-01是PLL （锁相环）的基础
它使用一个时钟发生器
内部VCSO （压控
SAW振荡器）来产生一个非常
低抖动的输出时钟。它是理想的
千兆位以太网。输出时钟
的（频率
156.25
or
187.50
兆赫
例如）是由两个设置
LVPECL时钟输出对。 （指定频率的时间
输出频率的精度的顺序。 ）
保证通过内部PLL ，其相位锁定
内部VCSO的参考输入频率（
25
or
30
兆赫例如）。输入参考既可以
是一个外部晶体，利用内部的晶体
振荡器，或者一个稳定的外部时钟源，如
封装晶体振荡器。
XTAL_2
NC
NC
NC
NC
VCC
DNC
DNC
DNC
28
29
30
31
32
33
34
35
36
M902-01
（ TOP VIEW ）
18
17
16
15
14
13
12
11
10
NC
NC
nFOUT1
FOUT1
GND
nFOUT0
FOUT0
VCC
GND
F
EATURES
◆
输出时钟频率从125MHz的到190MHz
（向厂家咨询的频率而定）
◆
两个相同的LVPECL输出对
◆
集成的SAW （表面声波）的延迟线
◆
低抖动0.5ps RMS （超过12kHz的- 20MHz的）
◆
非常适用于千兆位以太网时钟参考
◆
输出至输出歪曲< 100ps的
◆
外部XTAL或LVCMOS的参考输入
◆
可选的外部馈通时钟输入
◆
停止
时钟控制（逻辑1停止输出时钟）
◆
提供工业温度级
◆
单3.3V电源
◆
小9 ×9mm的SMT（表面贴装）封装
图1 ：引脚分配
例如输出频率配置
参考时钟
频率
（兆赫）
20
25
30
25/4
PLL
比
产量
频率
1
（兆赫）
125.00
156.25
187.50
应用
GND
GND
GND
OP_IN
nOP_OUT
雷士
VC
OP_OUT
nOP_IN
1
2
3
4
5
6
7
8
9
GBE
10GbE
12GbE
表1 ：示例输出频率配置
注1 ：指定输出时钟频率在订货时
S
IMPLIFIED
B
LOCK
D
IAGRAM
M902-01
VSCO
外
水晶
or
参考
时钟输入
（例如，25或30MHz的）
XTAL
OSC
分频器
频率
倍增
PLL
O
1
LVPECL
产量
双时钟
（例如， 156.25
或187.50MHz ）
外
环路滤波器
外
时钟
输入
外
时钟
SELECT
产量
时钟停止
控制
图2 ：简化框图
M902-01数据表版本2.1
M902-01 VCSO基于千兆以太网时钟发生器
修订后的24Jun2004
●
我ntegrated ircuit S ystems ，我NC 。
网络通信&
●
W W瓦特I C S T 。 C 0米
●
电话：（ 508 ） 852-5400
