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CY7C1361B
CY7C1363B
CY7C1363B ：引脚定义
（续）
名字
ADSC
TQFP
(3-Chip
启用）
85
TQFP
(2-Chip
启用）
85
BGA
(2-Chip
启用）
B4
FBGA
(3-Chip
启用）
A8
I / O
输入 -
同步
描述
从控制器的地址选通，
采样在CLK的上升沿，
低电平有效。
当置为低电平，
提供给该装置的地址是
捕获在地址寄存器中。一
[1:0]
是
还装入串计数器。当
ADSP和ADSC都断言，只有
ADSP是公认的。
ZZ
64
64
T7
H11
输入 -
ZZ “休眠”输入，高电平有效。
当
异步置为高电平，将器件置于一个
非时间关键“休眠”状态的数据
完整地保存下来。对于正常操作，
该引脚为低电平或悬空。 ZZ引脚
有一个内部上拉下来。
I / O-
同步
双向数据I / O线。
作为输入，
他们送入片内数据寄存器，
由CLK的上升沿触发。如
输出，它们提供包含在数据
由所指定的存储器位置
在先前提出的地址
时钟上升沿读周期。的方向
该引脚是通过OE控制。当OE
低电平时，引脚用作输出。
当HIGH ， DQ
s
和DQP
[A ： B]
放置
在一个三态condition.The输出
数据过程中自动三态
写序的部分，在第一
时钟从取消的时候出现
状态，并且所述装置的选择取消时，
不管OE的状态。
双向数据奇偶校验I / O线。
在功能上，这些信号是相同的
DQ
s
。在写序列， DQP
[A ： B]
is
通过控制体重
[A ： B]
水涨船高。
选择爆秩序。
当连接到GND
选择线性突发序列。当绑
V
DD
或悬空选择交错爆裂
序列。这是一个带针和应
留在器件工作期间是静态的。模式
引脚具有内部上拉电阻。
DQ
s
58,59,62,63 ， 58,59,62,63 ， P7 ， K7 ， G7 ， J10 ， K10 ，
68,69,72,73 ， 68,69,72,73 ，E7 ，F6， H6， L10， M10，
8,9,12,13,
8,9,12,13 ，L6， N6 ，D1， D11 ， E11，
18,19,22,23 18,19,22,23 H1 ，L1， N1 ，F11， G11， J1，
E 2 ，G 2， K 2 ，K 1 ，L ，M1
M2
D2,E2,F2,
G2
DQP
[A ： B]
74,24
74,24
D6,P2
C11,N1
I / O-
同步
模式
31
31
R3
R1
输入静态
V
DD
15,41,65,91 15,41,65,91 C4， J2 ，J4，
J6,R4
D4,D8,E4,
E8,F4,F8,
G4,G8,
H4,H8,J4,
J8,K4,K8,
L4,L8,M4,
M8
C3,C9,D3,
D9,E3,E9,
F3,F9,G3,
G9,J3,J9,
K3,K9,L3,
L9,M3,M9,
N3,N9
电源
电源输入的核心
装置。
V
DDQ
4,11,20,27 ， 4,11,20,27 ，A 1， A 7 ，F1
54,61,70,77 54,61,70,77 F7 ， J1 ， J7 ，
M1,M7,U1
,U7
I / O电源
供应
电源为I / O电路。
文件编号： 38-05302牧师* B
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