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FLEX 10K嵌入式可编程逻辑器件系列数据手册
图7
显示如何
n位
全加器可以被实现
n
+ 1个LE
与进位链。 LUT的一个部分产生两个比特的总和
使用输入信号和进位信号的装置;的总和被路由到
输出LE的。该寄存器可以被绕过的简单加法器或
用于累加器函数。进位链逻辑产生的
进位输出信号，该信号直接路由到的next-的进位信号
高阶位。最后的进位输出信号被路由到一个LE ，它可以
可以用作一个通用的信号。
图7.进连锁经营（ n位全加器）
送修
a1
b1
LUT
注册
s1
进位链
LE1
a2
b2
LUT
注册
s2
进位链
LE2
an
bn
LUT
注册
sn
进位链
LEN
LUT
注册
进位
进位链
LEN + 1
16
Altera公司。
