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HYS[64/72]D[16x01/32x00/64x20][G/E]U-[5/6/7/8]-B
无缓冲DDR SDRAM模块
引脚配置
表5
正面
针＃
40
41
42
43
44
45
46
47
符号
DQ27
A2
针＃
85
86
87
88
89
90
91
92
符号
引脚配置
（续）
背面
针＃
132
133
134
135
136
137
138
139
符号
针＃
177
178
179
180
181
182
183
184
符号
DM7/DQS16
DQ62
DQ63
V
DD
DQS7
DQ58
DQ59
V
SS
DQ31
NC / CB4
NC / CB5
V
SS
A1
NC / CB0
NC / CB1
V
DDQ
SA0
SA1
SA2
V
SS
NC
SDA
SCL
V
DDQ
CK0
CK0
V
DD
NC / DQS8
V
SS
V
DDSPD
注：引脚44 ， 45 ， 47 ， 49 ， 51 ， 134 ， 135 ， 140和144 NC （ “未连接” ）上
×
64有组织的非ECC
模块。
表6
密度
128MB
256MB
256MB
512MB
512MB
地址格式
组织
16M
×
64
32M
×
64
32M
×
72
64M
×
64
64M
×
72
内存
秩
1
1
1
2
2
SDRAM的
16M
×
16
32M
×
8
32M
×
8
32M
×
8
32M
×
8
排名第
SDRAM的
4
8
9
16
18
＃行/银行/
比特列
13/2/10
13/2/11
13/2/11
13/2/11
13/2/11
刷新
8K
8K
8K
8K
8K
期
64毫秒
64毫秒
64毫秒
64毫秒
64毫秒
间隔
7.8
s
7.8
s
7.8
s
7.8
s
7.8
s
数据表
10
V1.1, 2003-07
