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电气和热特性
表10.处理器总线AC时序规范
1
（续）
在推荐工作条件（见
表3）
所有速度等级
参数
系统时钟为ARTRY预充电后，高阻抗
符号
民
t
KHARPZ
—
最大
2
t
系统时钟
2, 3, 5
单位
笔记
注意事项：
之前的版本2.8 （修订版E） 1.修正在性能上是有限的，不符合此规范。欲了解更多信息，请参阅
10.2节， “零件编号不完全文档处理。 ”
2.通过设计和特性保证。
3. t
系统时钟
是外部时钟（SYSCLK ）在纳秒的周期。在表中给出的号码必须由系统时钟的周期要被乘
计算所讨论的参数的实际持续时间（单位：ns ） 。
4.每了60倍的总线协议， TS ，ABB和DBB仅由当前活动的总线主控器驱动。他们置为低电平，然后预充高
回到高阻如图前
图6 。
标称预充电宽度TS ， ABB ，或DBB是0.5
×
t
系统时钟
即，小于
最低牛逼
系统时钟
期间，要确保另一个主在下一时钟断言TS ， ABB ，或DBB不会与预充电抗衡。
输出有效，输出保持时间进行测试的信号置为有效。输出有效时间为预充电测试。高-Z的行为是
通过设计保证。
5.每60X总线协议， ARTRY可以通过时钟周期后立即AACK来驱动多个总线主设备。总线争
是不是因为任何主ARTRY主张将驾驶它低的问题。任师傅以下AACK置为低电平，在第一个时钟就会
预充电AACK的断言之后的第二周期期间，高之前进入高阻一个时钟。标称预充电宽度
ARTRY是1.0吨
系统时钟
;也就是说，它应该是高Z所示的
图6
之前的另一个主断言ARTRY的第一次机会。产量
有效并输出保持时间进行测试的信号置为有效。输出有效时间为预充电测试。高-Z和预充电行为
通过设计保证。
6. MCP和SRESET必须保持断言了至少2个总线时钟周期; INT和SMI应保持有效，直到异常
是取; CKSTP_IN必须保持有效，直到该系统已复位。见
MPC750 RISC微处理器系列用户手册
了解更多信息。
MPC755 RISC微处理器硬件规格，版本6.1
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飞思卡尔半导体公司
