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TS68040
数据中的每个存储器页缓冲能力是由两个比特中的页面描述符的控制
每一页。可缓存的网页可以是直写或回拷的，没有直写
分配给偏出通过网页写。非超高速缓存的页面，也可以指定
作为非超高速缓存I / O ，迫使访问这些网页出现，以教学
执行。
高速缓存一致性
该TS68040过程中有其他公交访问窥探外部总线的能力
主人保持TS68040的高速缓存和外部存储器之间的一致性
系统。外部写周期被两个指令高速缓存和数据窥探
高速缓存;然而，外部读周期仅由数据高速缓存窥探。此外，
外循环可被标记的总线探听或非探听上。当一个
外部循环被标记为可探听的，总线窥探者检查高速缓存的相干
基于相应的高速缓存行的状态和外部类型ency冲突
周期。
虽然内部执行单元和总线窥探者电路都可以访问
片上高速缓存，该监听器的优先级高于所述执行单元，以使窃听者对
立即解决一致性不符。
缓存的说明
该TS68040支持缓存维护下面的说明。这两个指令
系统蒸发散可以对数据或指令高速缓存器选择性地操作。
CINV ：无效单行，在一个物理页的所有行或整个缓存。
CPUSH ：选择推脏数据的高速缓存行到内存中，然后全部无效选择
线。
操作数转换
机制
传输类型
该TS68040外部同步总线支持多个主机和重叠仲裁
化与数据传输。总线被优化以执行高速数据传送到并
从外部高速缓冲存储器或存储器中。的数据和地址总线都是32位宽。
该TS68040提供了两个信号（ TT1 - TT0 ）的定义四种类型的总线传输：
正常访问， MOVE16接入，备用访问，并中断响应的访问。
正常访问正常识别的内存引用： MOVE16访问是记忆力
由MOVE16指令访问;和备用访问标识的访问
未定义的地址空间（功能代码值0 ，3， 4,7） 。中断应答响应
边缘接入用于取异常中断处理过程中的中断向量。
在突发读取写入高速缓存转移，在地址和传输类型的值
信号不发生变化;它们的高速缓存行的第一请求的项的地址。
当TS68040请求的高速缓存行的突发读传输，地址总线indi-
凯茨的长型字中的第一所需的线的地址，但该存储器系统是
预期提供在下面的顺序（模4）数据：0， 1，2， 3 （长字偏移） 。
需要可能无法从偏移量为0的第一个地址;然而，所有四个长字
必须被转移。猝发写操作发生在一个类似的方式。
总线窥探确保了在主存储器中的数据是在芯片上的数据一致
缓存。如果备用总线主机进行总线上读传输窥探
被使能，并且如果该窥探逻辑确定芯片上的数据缓存有脏数据
（数据有效，但与内存不一致）此传输，内存被阻止
从响应于所述读请求，并且TS68040直接提供的数据提供给
高手。如果备用主站进行总线上的写传输窥探是
使能，且如果窥探者判定片上高速缓存中的一个具有一个有效的行
此请求，则窃听者可以或者无效或更新该行，选择
的监视控制信号。
突发传输操作
公交窥探
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2116A–HIREL–09/02
