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IDT70V7339S
高速512K ×18的同步行切换的双端口静态RAM
工业和商业温度范围
引脚名称
左侧端口
CE
0L
,
CE
1L
读/写
L
OE
L
BA
0L
- BA
5L
A
0L
- A
12L
I / O
0L
- I / O
17L
CLK
L
PL / FT
L
ADS
L
CNTEN
L
重复
L
LB
L
,
UB
L
V
DDQL
选择
L
V
DD
V
SS
TDI
TDO
TCK
TMS
TRST
正确的端口
CE
0R
,
CE
1R
读/写
R
OE
R
BA
0R
- BA
5R
A
0R
- A
12R
I / O
0R
- I / O
17R
CLK
R
PL / FT
R
ADS
R
CNTEN
R
重复
R
LB
R
,
UB
R
V
DDQR
选择
R
芯片使
读/写使能
OUTPUT ENABLE
银行地址
(4)
地址
数据输入/输出
时钟
流水线/流通型
地址选通启用
柜台启用
反反复
(3)
字节允许（ 9位字节）
电源（ I / O总线） （ 3.3V或2.5V ）
(1)
选项用于选择V
DDQX
(1,2)
电源（ 3.3V ）
(1)
地（ 0V ）
测试数据输入
测试数据输出
测试逻辑时钟（ 10MHz时）
测试模式选择
复位（初始化TAP控制器）
5628 TBL 01
名字
注意事项：
1. V
DD
， OPT
X
和V
DDQX
必须先设置为合适的工作水平
施加在I / O和控制该端口的输入。
2. OPT
X
选择工作电压电平为在该端口上的输入/输出和控制。
如果OPT
X
设置为VIH （ 3.3V ） ，那么该端口的I / O和控制将工作在3.3V
水平和V
DDQX
必须在3.3V供电。如果OPT
X
被设置为VIL （0V ），则该
端口的I / O和地址控制将在2.5V的水平和V操作
DDQX
必须是
在2.5V供电。在OPT管脚是相互独立的另一个，两个端口可以
在3.3V电平工作，既可以在2.5V电平工作，或一方可以操作
在3.3V与其他在2.5V 。
3.当
重复
X
是断言，计数器将重置为加载的最后一个有效地址
通过
ADS
X
.
4.访问由端口进入特定银行的银行地址控制
用户的直接控制之下引脚：每个端口都可以访问存储任何银行
与当前未正在由相对端口访问的共享阵列
（即， BA
0L
- BA
5L
≠
BA
0R
- BA
5R
） 。倘若两个端口尝试访问
在同一时间同一行，也访问将是有效的，并且在这两个数据
该银行内部的端口有针对性的具体地址可能会被破坏（在
这任一个或两个端口都写）或可能导致无效的输出的情况下（在
这两个端口都试图读取的情况下） 。
6.42
5
