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莱迪思半导体公司
表3.额定输出占空比与V分频器设置
分频器设置
用50％的输出
占空比
V
2
4
8
12
16
20
24
28
32
36
40
44
48
52
56
60
64
50
DC ％
ispClock5600系列数据手册
分频器设置与
非50 ％占空比输出
周期
V
6
10
14
18
22
26
30
34
38
42
46
50
54
58
62
DC ％
33
40
43
44
45
46
47
47
47
48
48
48
48
48
48
PLL_BYPASS模式
该PLL_BYPASS模式被设置，使得输入参考信号可以通过被耦合到输出端，而不
使用PLL功能。当启用PLL_BYPASS模式（ PLL_BYPASS =高） ，对M分频器的输出
被直接路由到的V分频器的输入。在PLL_BYPASS模式下，在V分频器标称值是
减半，以使它们提供的分频比为1至32的输出频率为一个给定的V分频器（六
k
）会
被确定
f
k
=
f
REF
x 2
一M× V
k
(2)
请注意， PLL_BYPASS模式主要是提供用于测试目的。当PLL_BYPASS模式
启用功能，如锁定检测和歪斜的产生是不可用的。
参考和外部反馈输入
该ispClock5600提供套CON连接可配置，内部端接输入为时钟参考和反馈
信号。在正常操作中，时钟参考输入对中的一个（ REFA +/-或REFB +/-）被用作时钟
输入。
外部反馈输入，使得能够在交货点采样的输出信号。这使得POS-
sible提供输出时钟具有非常低歪斜相对于基准时钟而不管负载的
的影响。
该ispClock5610提供一个输入信号对参考输入和一个输入对外部反馈，而
在ispClock5620提供了两个对的参考信号和两对反馈。要参考的选择
和反馈输入， ispClock5620提供了两个CMOS兼容的数字输入所谓REFSEL和FBKSEL 。
表4示出的这两个控制输入的行为。
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