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初步的技术数据
SPDIF发射器输入数据时序
都为输入端口的定时要求在给定的
表32 。
输入信号（SCLK ，FS SDATA ）被路由至
DAI_P20-1销用主控板。因此，定时规范
下面提供系统蒸发散是在DAI_P20-1引脚有效。
表32. SPDIF发射器输入数据时序
参数
时序要求
t
SIFS
1
FS设置SCLK上升沿之前
1
t
SIHFS
FS保持SCLK上升沿后
1
t
SISD
SDATA设置SCLK上升沿之前
1
t
SIHD
SDATA保持SCLK上升沿后
时钟宽度
t
SISCLKW
t
SISCLK
时钟周期
1
ADSP-21365/6
民
4
5.5
4
5.5
9
20
最大
单位
ns
ns
ns
ns
ns
ns
数据， SCLK ， FS可以来自任何DAI引脚。 SCLK和FS也可以来通过PCG或运动。 PCG的输入可以是CLKIN或任意DAI引脚。
采样边沿
t
SISCLKW
DAI_P20-1
（SCLK）
t
SISFS
DAI_P20-1
（ FS ）
t
SIHFS
t
SISD
DAI_P20-1
（ SDATA ）
t
SIH
图30. SPDIF发射器输入时序
在采样时钟（ TXCLK ）开关特性
SPDIF发射器有一个过采样时钟。这TXCLK
输入分频，产生双相时钟。
表33.在采样时钟（ TXCLK ）开关特性
参数
TXCLK频率TXCLK = 768 × FS
TXCLK频率TXCLK = 512 × FS
TXCLK频率TXCLK = 384 × FS
TXCLK频率TXCLK = 256 × FS
帧率
民
最大
147.5
98.4
73.8
49.2
192.0
单位
兆赫
兆赫
兆赫
兆赫
兆赫
牧师PRA |
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2004年9月
