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三菱的LSI
M5M5V4R01J-12,-15
1997年11月20日Rev.F
4194304 - BIT （ 4194304 - WORD BY 1位） CMOS静态RAM
描述
该M5M5V4R01J是由1位的静态一族4194304字
公羊，制造的高性能CMOS硅栅
处理而设计的高速应用。
该M5M5V4R01J是在一个32引脚塑料小外形J-提供
引线封装（ SOJ ） 。
这些器件工作在3.3V单电源供电，并直接
TTL兼容。它们包括降低功能的电源也是如此。
地址
输入
芯片选择
输入
引脚配置（顶视图）
特点
M5M5V4R01J-12
12ns(max)
M5M5V4R01J-15
15ns(max)
低功耗
活跃
297mW(typ)
支持
3.3mW(typ)
+ 3.3V单电源供电
全静态操作：无时钟，无刷新
测试模式可用
易于内存扩张
三态输出：或领带的能力
OE防止数据争用的I / O总线
直接TTL兼容：所有输入和输出
快速存取时间
A
0
A
1
A
2
A
3
A
4
A
5
S
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
(3.3V)
V
CC
(0V)
GND
数据输入
写控制
输入
地址
输入
D
W
A
6
A
7
A
8
A
9
A
10
A
21
A
20
A
19
地址
输入
A
18
A
17
A
16
OUTPUT ENABLE
OE
输入
GND
(0V)
V
CC
(3.3V)
数据输出
Q
A
15
A
14
地址
A
13
输入
A
12
A
11
B1/B4
字节控制
输入
M5M5V4R01J
32P0K
概要
应用
高速存储单元
包
32引脚400mil SOJ
框图
A
0
A
1
A
2
地址
输入
3
4
5
6
ROW输入缓冲器
A
3
A
4
A
5
存储阵列
512行
8192柱
输出缓冲器
2
行地址解码器
1
23 Q
输出
数据
A
6
12
A
7
13
A
8
14
S
7
列I / O电路
列地址
COLUMN
地址
解码器
解码器
COLUMN输入缓冲器
数据输入缓冲器
10 D
输入/
8
24
9
25
VCC （ 3.3V ）
数据
W
11
OE 26
B1/B4 17
15 16 18 19 20 21 22 27 28 29 30 31 32
A
9
A
10
A
11
A
12
A
13
A
14
A
15
A
16
A
17
A
18
A
19
A
20
A
21
地址
输入
GND （0V）
三菱
电
1
