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ADSP-21161N
SPI接口规范
表36. SPI接口协议 - 主站切换和定时
100兆赫
最大
110兆赫
最大
参数
时序要求
t
SSPIDM
数据输入有效到SPICLK边沿（数据输入建立时间）
t
HSPIDM
SPICLK最后采样边沿到数据输入无效
开关特性
t
SPICLKM
串行时钟周期
t
SPICHM
串行时钟高周期
串行时钟低电平时间
t
SPICLM
t
DDSPIDM
SPICLK边沿到数据输出有效（数据输出延迟时间）
t
HDSPIDM
SPICLK边沿到数据输出无效（数据输出保持时间）
t
SDSCIM_0
FLAG3-0 （ SPI设备选择）低一SPICLK边缘的
CPHASE = 0
t
SDSCIM_1
FLAG3-0 （ SPI设备选择）低一SPICLK边缘的
CPHASE = 1
t
HDSM
最后SPICLK边到FLAG3-0高
t
SPITDM
连续传输延迟
民
民
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.5t
CCLK
+10
0.5t
CCLK
+1
8t
CCLK
4t
CCLK
–4
4t
CCLK
–4
3
0
5t
CCLK
3t
CCLK
t
CCLK
–3
2t
CCLK
0.5t
CCLK
+10
0.5t
CCLK
+1
8t
CCLK
–4
4t
CCLK
–4
4t
CCLK
–4
3
0
5t
CCLK
3t
CCLK
t
CCLK
–3
2t
CCLK
FLAG3-0
（输出）
t
S
D
S
CIM
SPICLK
（CP = 0）
（输出）
t
S
PICHM
t
S
PICLM
t
S
PICLKM
t
HD
S
M
t
S
PIT DM
t
S
PICLM
SPICLK
（CP = 1）
（输出）
t
S
PICHM
t
D D
S
P I D M
MOSI
（输出）
最高位
t
HDSPIDM
最低位
t
S S
P I D M
CPHASE = 1
MISO
（输入）
最高位
有效
t
SS
马存保机构
t
H
S
马存保机构
最低位
有效
t
H
S
P I D M
t
DD
S
马存保机构
MOSI
（输出）
CPHASE = 0
MISO
（输入）
最高位
t
HD
S
马存保机构
最低位
t
SS
马存保机构
最高位
有效
t
H
S
马存保机构
最低位
有效
图31. SPI接口协议 - 主站切换和定时
版本C |
第50页60 |
2013年1月
