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ADSP-21161N
数据接收 - 内部时钟
DRIVE EDGE
样品
EDGE
数据接收 - 外部时钟
DRIVE EDGE
样品
EDGE
t
SCLKIW
SCLK
SCLK
t
SCLKW
t
DFSI
t
HOFSI
FS
t
DFSE
t
SFSI
t
HFSI
FS
t
HOFSE
t
SFSE
t
高场强元素
t
SDRI
D
X
A / D
X
B
t
HDRI
D
X
A / D
X
B
t
SDRE
t
HDRE
注意：无论是上升沿或下降沿
SCLK
（外部）
SCLK
（内部）可以用来作为活动
采样
边缘。
传输数据 - 内部时钟
DRIVE EDGE
样品
EDGE
传输数据 - 外部时钟
DRIVE EDGE
样品
EDGE
t
SCLKIW
SCLK
SCLK
t
SCLKW
t
DFSI
t
HOFSI
FS
t
DFSE
t
SFSI
t
HFSI
FS
t
HOFSE
t
SFSE
t
高场强元素
t
HDTI
D
X
A / D
X
B
t
DDTI
D
X
A / D
X
B
t
HDTE
t
DDTE
注意：无论是上升沿或下降沿
SCLK
（外部）
SCLK
（内部）可以用来作为活动
采样
边缘。
DRIVE EDGE
SCLK
（ EXT ）
SCLK
DRIVE EDGE
t
DDTEN
D
X
A / D
X
B
DRIVE EDGE
SCLK
（ INT ）
SCLK
t
DDTTE
DRIVE EDGE
t
DDTIN
D
X
A / D
X
B
t
DDTTI
图29.串行端口
版本C |
第48页60 |
2013年1月
