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CY7C1327G
引脚德网络nitions
名字
A
0
, A
1
, A
I / O
描述
输入 -
用于选择的256千地址位置中的一个地址输入。
取样的上升沿
同步的CLK ，如果ADSP ADSC或低电平有效，和CE
1
，CE
2
和CE
3
采样活跃。 A1和A0送入的2比特
计数器。
输入 -
字节写选择输入，低电平有效。
合格与BWE进行字节写入到SRAM中。采样
同步的在CLK的上升沿。
输入 -
全局写使能输入，低电平有效。
当在CLK的上升沿，一个全局写断言低
同步进行（所有字节写入，无论价值的BW
[A ： B]
和BWE ） 。
输入 -
字节写使能输入，低电平有效。
采样在CLK的上升沿。这个信号必须置
同步LOW进行字节写操作。
输入 -
时钟
时钟输入。
用于捕获所有的同步输入到设备中。还用于增加爆
在ADV为低电平时，一阵操作过程中的计数器。
BW
A
， BW
B
GW
BWE
CLK
CE
1
输入 -
芯片使能1输入，低电平有效。
采样在CLK的上升沿。使用与CE联
2
同步和CE
3
选择/取消选择该设备。如果CE ADSP被忽略
1
为HIGH 。 CE
1
仅当新的采样
外部地址被加载。
输入 -
芯片使能2输入，高电平有效。
采样在CLK的上升沿。使用与CE联
1
同步和CE
3
选择/取消选择该设备。 CE
2
只有当一个新的外部地址被装入取样。
输入 -
芯片使能3输入，低电平有效。
采样在CLK的上升沿。使用与CE联
1
同步和CE
2
选择/取消选择该设备。 CE
3
只有当一个新的外部地址被装入取样。
输入 -
输出使能，异步输入，低电平有效。
控制的I / O引脚的方向。当低，
异步的I / O引脚用作输出。当拉高高， I / O引脚为三态，并作为输入数据引脚。
OE是在读周期的第一个时钟从取消选择状态出现时被屏蔽。
输入 -
提前输入信号，采样CLK ，低电平有效的上升沿。
当断言，它
同步自动递增的猝发周期的地址。
输入 -
地址选通的处理器，采样CLK ，低电平有效的上升沿。
当断言
同步LOW时， A被捕获在地址寄存器中。 A1 ： A0也加载到爆计数器。当ADSP
和ADSC都断言，只有ADSP是公认的。 ASDP被忽略时， CE
1
被拉高高。
输入 -
ZZ “休眠”输入，高电平有效。
这个输入，当高处的设备在非时间关键“休眠”
异步状态与数据的完整性保护。在正常操作期间，该引脚为低或悬空。 ZZ
引脚具有内部上拉下来。
输入 -
地址选通脉冲从控制器，采样CLK ，低电平有效的上升沿。
当断言
同步LOW时， A被捕获在地址寄存器中。 A1 ： A0也加载到爆计数器。当ADSP
和ADSC都断言，只有ADSP是公认的。
I / O-
双向数据I / O线。
作为输入，它们馈入由所述触发芯片上的数据寄存器
CLK的同步上升沿。作为输出，它们提供包含在由“A”指定的存储单元中的数据
在读周期的前一个时钟的上升。销的方向由OE控制。当OE
为低电平时，引脚用作输出。高电平时， DQS和DQP
[A ： B]
被放置在一个三态
条件。
电源
电源输入到该装置的核心。
地
I / O接地
输入 -
STATIC
–
地面的装置。
地面的I / O电路。
选择爆秩序。
当连接到GND选择线性突发序列。当连接到V
DD
或悬空
选择交错突发序列。这是一个带针，并应装置运行过程中保持不变。
模式引脚有一个内部上拉电阻。
未连接。
内部没有连接到芯片。 NC / 9M ， NC / 18M ， NC / 72M ， NC / 144M ， NC / 288M ，
NC / 576M和NC / 1G的地址扩展引脚内部没有连接到芯片。
CE
2
CE
3
OE
ADV
ADSP
ZZ
ADSC
DQ
A,
DQ
B
,
DQP
A,
DQP
B
V
DD
V
SS
V
DDQ
模式
NC ， NC / 9M ，
NC/18M,
NC/72M,
NC/144M,
NC/288M,
NC/576M,
NC/1G
文件编号： 38-05519牧师* K
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