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先进的硬件架构，公司
中通液，数据流经
类似的编码和解码设备
操作。在初始化过程中该装置是
编程的，如上所示。校验字节
在0X02的范围设定为0x14.5 。该
块长度这里是消息的字节数之和
校验字节喜欢的编码和解码模式
即使该设备通过该操作
数据不变块。
1）初始化后，系统时钟
码字到输入缓冲器。
2）码字由ECC处理
模块传递到输出缓冲区
无修正。
3 ）未校正码字可在
的输出端口。在RDYON国家
确定有效数据的可用性。
在清除输入被忽略
输入缺相和ERR和CRTN输出
是无效的。
警告：
该设备没有规定的，用于指示
的开始和/或消息的末尾或检查字节。这是
系统设计人员的责任来跟踪
消息和校验字节的转换，如果需要的话。
2.9
数据速率和延迟
本节介绍的数据速率和处理
延迟突发和连续操作。
处理延迟是在编码，解码的相同
或直通模式操作。
的输入和输出速率不必是相同的
突发和连续操作。无寄存器
该设备的任何操作编程所需。
连续的数据块流，通过使用所获得的
每字节和块钟表的适当数量
长度。可替换地，数据流入和流出的
设备使用而被控制的控制信号， DSIN和
DSON 。
2.9.1
突发操作
2.8
缓冲器
输入端口包含一个单端口367x9
缓冲区。输出端口包含一个单端口
256x9缓冲区。这些缓冲器存储输入和输出
数据在修正过程中，有利于维护
所希望的系统的数据速率。该缓冲器支持
在其运作阶段， ECC模块：数据，
计算和数据输出。复位操作
在2.6节中描述
复位和初始化
顺序
清除缓冲区。
使用内部缓冲区的每受限
在2.9节中定义的规则
数据速率和
潜伏期。
这些规则定义的限制
使用该缓冲器来暂时存储一个以上的
块。强烈建议系统
设计师了解清楚之前，这些规则
设计该系统。
输入缓冲器接收的DI输入数据
总线时ECC模块是在计算中或在
数据在所需的系统速率相。能力
输入缓冲器接收数据以表示
RDYIN 。
输出缓冲区接收从修正后的数据
在数据输出阶段的ECC 。更正
放置在缓冲液中在1个时钟每字节由ECC
模块由系统在它的所希望的去除
率。 RDYON被置为低电平时，输出
缓冲器能够输出数据。
最大处理延迟，以正向顺序，
表示在时钟数，对于脉冲串操作是
由下式确定：
N
×
C
i
+
R
+ 60 +
N
定义：
C
i
=每字节的输入时钟频率。如果C
i
= 1 ，则使用的值
对于C
i
2 ，在延迟方程。
N =块长度
R =校验字节数
处理延时=延迟从第一个输入字节
第一个输出字节
对于使用每字节1个时钟周期为6 MHz系统，
等待时间和数据速率示于表
突发操作。输入和输出突发速率在所有的
情况下为6兆字节/秒。注：其他频率
操作可以类似地推导。
输出缓冲器可以用来从保存数据
而输入缓冲器被填满一个块
下面的程序段。在警告中列出的两个规则
必须做到这一点。这些都说明
在图5中：
连拍和连续作战。
注意事项：
1.输出块的，我必须开始一致或
块我输入之前
+
1.
2.输出块我必须完成的：
处理延迟
N
8个时钟周期后，
块我开始
+
升上输入。
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PS4012B-0100
