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电源电流（ μA ）
转换器不仅采用了电源上的每个DCLOCK转型
（这是典型的数字CMOS元件），但是也使用
一些当前的模拟电路，如compara-
器。模拟部分不断消耗功率，直到
掉电模式进入。
图3显示了ADS7816的电流消耗
相对于采样速率。对于该图中，转换器的时钟
在3.2MHz的，无论采样率-CS为高电平的
剩余的采样周期。图4还示出了电流
消耗与采样速率。然而，在这种情况下，该
DCLOCK期为采样周期-CS的1 / 16日是
高一DCLOCK周期，每16 。
还有就是断电的重要区别
该转换后的输入模式是完整的和
这是启用当CS为高电平全掉电模式。
同时兼具省电模拟部分，数字部分
断电，只有当CS为高电平。因此，如果CS是左
低在一个转换结束时，转换器是continu-
同盟主频，功耗也不会低到
当CS为高电平。参见图5的更多信息。
通过降低所述参考电压时， ADS7816需要
更小的电流对完全充电的内部电容
两个模拟输入和参考输入。本次减持
在功耗应该仔细对称重
造成概述增加噪声，失调和增益误差
在参考部分。的功耗
ADS7816被减小约10％时的基准电压
年龄和输入范围从5V变到100mV的。
短循环
1000
100
10
T
A
= 25°C
V
CC
= V
REF
= +5V
f
CLK
= 3.2MHz的
1
1
10
100
1000
采样率（千赫）
图3.维护F
CLK
在可能的最高速率
使电源电流与直接拖放
采样率。
1000
电源电流（ μA ）
100
10
T
A
= 25°C
V
CC
= V
REF
= +5V
f
CLK
= 16 f
样品
1
节省功率的另一种方法是利用CS信号到
短周期的转换。由于ADS7816的地方
在D最新数据位
OUT
行，因为它产生的
转换器可以很容易地短循环。此术语是指
转化可以在任何时间终止。例如，
如果只需要8位的转换的结果，则
转换后，可终止（拉CS高）
第8位已同步输出。
这种技术可用于降低功耗
（或增加的转化率），在这些应用
其中的模拟信号被监视，直到一些CON-
DITION为真。例如，如果信号是一个外
预定的范围内，全部12位转换结果可能
没有必要。如果是这样，在转换之后被终止
第一n位，其中n可以是低至3或4。这
导致较低的功耗都转换器和
该系统的其它部分，因为它们花费更多的时间，在功率
掉电模式。
1
10
100
1000
采样率（千赫）
图4.缩放F
CLK
降低电源电流仅
稍微用采样率。
60
50
T
A
= 25°C
V
CC
= V
REF
= +5V
f
CLK
= 16 f
样品
电源电流（ μA ）
40
30
20
10
0
1
10
100
CS低
（GND）的
CS = HIGH （V
CC
)
1000
布局
为了获得最佳性能，应注意使用
该ADS7816电路的物理布局。这是特别
如果参考电压真低和/或转化率
高。在200kHz转换率， ADS7816成为位
决定每312ns 。也就是说，对于每个随后的比特决策
采样率（千赫）
图5.关断电流是相当低的有
CS高比当CS为低电平。
11
ADS7816
