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ADuC7036
引脚配置和功能描述
48
47
46
45
44
43
42
41
40
39
38
37
LIN / BSD
IO_VSS
的STi
NC
VSS
NC
VDD
WU
NC
NC
NC
XTAL2
RESET
GPIO_5/IRQ1/RxD
1
2
销1
指标
GPIO_6 / 3的TxD
GPIO_7 / IRQ4 4
GPIO_8 / IRQ5 5
6 TCK
TDI 7
DGND 8
NC 9
TDO 10
11 NTRST
TMS 12
ADuC7036
顶视图
（不按比例）
36
35
34
33
32
31
30
29
28
27
26
25
XTAL1
DGND
DGND
REG_DVDD
NC
GPIO_4/ECLK
GPIO_3/MOSI
GPIO_2/MISO
GPIO_1/SCLK
GPIO_0/IRQ0/SS
NC
NC
图7.引脚配置
表7.引脚功能描述
PIN号
1
助记符
RESET
TYPE
1
I
描述
复位输入管脚。低电平有效。该引脚具有内部上拉电阻弱到REG_DVDD和
应该悬空在不使用时。为增加安全性和鲁棒性，这是
建议将此引脚通过电阻REG_DVDD绑。
通用数字I / O 5 /外部中断请求1 /接收数据的UART串行端口。通过
默认和上电复位后，该引脚配置为输入。该引脚具有内部弱
上拉电阻和悬空在不使用时。
通用数字I / O 6 /发送数据的UART串行端口。默认情况下，和一个加电后，
上电复位时，该引脚配置为输入。该引脚具有内部弱上拉电阻和
应该悬空在不使用时。
通用数字I / O 7 /外部中断请求4.默认情况下后上电
复位时，该引脚配置为输入。该引脚具有内部弱上拉电阻和应
悬空在不使用时。
通用数字I / O 8 /外部中断请求5.默认情况下后上电
复位时，该引脚配置为输入。该引脚具有内部弱上拉电阻和应
悬空在不使用时。
JTAG测试时钟。此时钟输入引脚的器件上的标准5针JTAG调试端口之一。
TCK仅仅是一个输入引脚和内部有一个弱上拉电阻。该引脚悬空
在不使用时。
JTAG测试数据输入。该数据输入引脚上的标准5针JTAG调试端口之一
的一部分。 TDI是只有一个输入引脚，并且具有一个内部，弱上拉电阻。该引脚可留
未连接时不使用。
接地参考的片上数字电路。
无连接。这些引脚没有内部连接，并保留以备将来使用。
因此，不要在外部连接这些引脚。这些引脚可以接地，如果需要的话。
2
GPIO_5/IRQ1/RxD
I / O
3
GPIO_6/TxD
I / O
4
GPIO_7/IRQ4
I / O
5
GPIO_8/IRQ5
I / O
6
TCK
I
7
TDI
I
8, 34, 35
9, 16, 17,
23, 25, 26,
32 ， 38
40, 43, 45
10
DGND
NC
S
TDO
O
JTAG测试数据输出。此数据输出引脚的标准的5针JTAG调试端口之一上
的部分。 TDO是唯一一个输出引脚。在上电时，该输出被禁止，并通过拉高
内部弱上拉电阻。该引脚悬空不使用时。
版本C | 16页132
07474-007
笔记
1. NC =无连接。
2.将裸露焊盘应连接到DGND 。
VBAT
VREF
GND_SW
NC
NC
VTEMP
IIN +
IIN-
AGND
AGND
NC
REG_AVDD
13
14
15
16
17
18
19
20
21
22
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24
